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  1. spi_cbb

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  2. 基于FPGA设计,verilog语言变成的,SPI通用接口模块,顶层已封装成类似标准的FIFO接口;提供仿真文件;仿真器为modelsim10.0c,波形观察debussy。-Based on the FPGA design, Verilog language into a, SPI universal interface module, the top has been packaged into a FIFO interface similar to that of the standard
  3. 所属分类:Com Port

    • 发布日期:2017-04-03
    • 文件大小:554234
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