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用 户 名:风行者19*****
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m60component20161109
- 用verilog语言实现的模为60的计数器,经编译合格,利用quarter2及以上可以直接使用,并使用了分块模式(Using Verilog language to achieve the modulus of 60 counters, compiled by qualified, using quarter2 and above can be used directly, and the use of sub block mode)