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  1. second&clk

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  2. 开发系统上采用的时钟信号的频率是20MHz，可分别设计计数器对其计数，包括计秒、分、小时、日、周、月以及年等。在每一级上显示输出，这样就构成了一个电子日历和时钟的模型。为了可以随意调整计数值，还应包含设定计数初值的电路

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：336695
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