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  1. div_clk

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  2. 主时钟为15.36MHz的带选通的8位输出分频器，可得到100Hz,120Hz,1kHz,10kHz的频率-Master clock for the 15.36MHz band strobe output 8-bit prescaler, can be 100Hz, 120Hz, 1kHz, 10kHz frequency

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-31
    • 文件大小：1148
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