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  1. canbus

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  2. 用verilog编写实现的CAN总线控制器源码,自带testbench,解压后用ISE打开工程文件即可。-Prepared with the verilog source code to achieve the CAN bus controller, bring their own testbench, after decompression project file can be opened with the ISE.
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-13
    • 文件大小:1079380
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