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  1. moter

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  2. it is a program that drive the motor for the PIC18f4520 that support large current-you can look at it and try it
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-12
    • 文件大小:770byte
    • 提供者:so
  1. led

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  2. 此源码可以在EASYFPGA是实现跑马灯程序-led
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:770byte
    • 提供者:yu
  1. test_serial_intruput

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  2. This code is written to test serial communication of 8051 family of microcontrollers. The code will echo what it recieves on its serial port.
  3. 所属分类:Other Embeded program

  1. IIRFloatingPoint

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  2. Implementation of a IIR filter in floating point
  3. 所属分类:DSP program

    • 发布日期:2017-04-10
    • 文件大小:770byte
    • 提供者:Carmen
  1. cartra

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  2. car traffic controller.........vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:770byte
    • 提供者:sheshu
  1. data_to_asc

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  2. 将二进制文件如图片转换为文本文件,用于FPGA的数表-translate binary to ASICII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:770byte
    • 提供者:邓海涛
  1. counter7

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  2. 4bit counter in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:770byte
    • 提供者:kashif ali
  1. code

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  2. 通过对十字路*通灯控制系统的设计,掌握不同进制计数归零的描述方法以 及通过信号使进程进行相互通信的方法。-Through the intersection traffic light control system design, master describes different methods to zero and the decimal counting processes via signal to communicate with each method.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:770byte
    • 提供者:张双图
  1. ps2_vga_top

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  2. PS2 WITH VGA FOR VERILOG ALTERA DE2
  3. 所属分类:VHDL-FPGA-Verilog

  1. ASK_DEMODULATION_AND_TEST_CODE

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  2. ASK解调VHDL程序及仿真,项目已使用,好用-ASK demodulation VHDL procedures and simulation, the project has been used, easy to use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:770byte
    • 提供者:于工
  1. lesson9-1

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  2. 这个是I2C的基本功能程序,初学者适用参考。-I2C basic procedures,Suitable for beginners reference.
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:770byte
    • 提供者:yuyu
  1. code-hmwk7

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  2. Make the required flag signals using the input clock signal (clk) and input flag (TKN). Whenever the TKN signal is activated, a sequence of activation of flag signals should be performed based on the timing diagram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:770byte
    • 提供者:mafa87
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