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  1. efdgdda

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  2. TI公司的DSP28335芯片的全套开发例程,对初学者很有用的~! -TI' s DSP28335 chip full development routines, useful for beginners ~!
  3. 所属分类:DSP program

    • 发布日期:2017-04-11
    • 文件大小:749
    • 提供者:erfsd
  1. JPEG2000

    0下载:
  2. 用于JPEG2000的53小波VHDL源码-53 for the JPEG2000 wavelet VHDL source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-05-16
    • 文件大小:749
    • 提供者:闫霜山
  1. beep

    0下载:
  2. 通过用开发板上的蜂鸣器来实现发出警车鸣笛声-With the development board through the buzzer to send police car siren sound to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:749
    • 提供者:崔冬博
  1. pinlvji

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  2. 频率计,51单片机用计数器做的,可以用来测频率。一般的课程设计可能会有用。-Frequency counter, the counter to do with the microcontroller 51 can be used to measure the frequency. The general curriculum design may be useful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:749
    • 提供者:吴程序
  1. BRAT

    0下载:
  2. early branch rename table-store rename table once the branch instruction comes in. Used in out of order pipeline processor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:749
    • 提供者:Isabella Ni
  1. dianziqin-music-bofangEDA

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  2. EDA编程 电子琴乐曲播放 EDA程序VHDL语言-Keyboard music playing eda program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:749
    • 提供者:liang
  1. 2

    0下载:
  2. Veriilog小程序,能实现特定功能。-Veriilog procedures to achieve specific functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:749
    • 提供者:于飞
  1. add

    0下载:
  2. 用verilog实现的可综合的16位和32位加法器,经过验证了。-Implementation addition with verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:749
    • 提供者:yangyang
  1. laser-Counter

    0下载:
  2. 利用LD激光器计数,可用于生产流水线上产品数量的自动计数-Using a LD laser counting, and can be used for the production line of automatic counting the number of products
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:749
    • 提供者:梁化春
  1. DS18B20LCD

    0下载:
  2. DS18C20采集温度并且在数码管上显示出来。-DS18C20 acquisition and temperature on the digital tube display
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:749
    • 提供者:赵军
  1. 1.3V-default

    0下载:
  2. 這是一個適用於1.8V轉1.3V必迴路 在1Mhz頻率下 RLC各為 25m 4.7u 10u 給有需要的同學作為參考-This is one for 1.8V 1.3V will turn 1Mhz frequency RLC circuit at each 25m 4.7u 10u to needy students as a reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:749
    • 提供者:王宇揚
  1. m

    0下载:
  2. 这是vhdl编写的产生7位m序列的程序,类比可以产生更多为的。而m序列即可作为输入测试信号,也可以模拟噪声。-It is written vhdl 7 m sequence generation process, can produce more for the analogy. The m-sequence can be used as an input test signal, it can simulate noise.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:749
    • 提供者:殷超
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