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  1. CANIORAW

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  2. lpc2292 can
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:1.37kb
    • 提供者:张云
  1. at91_led_blinking_patterns.c.tar

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  2. LED blinking code for at91sam9260
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-10
    • 文件大小:1.37kb
    • 提供者:pks
  1. 80C51-ADC

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  2. 80C51 的ADC 转换源代码,已经调试,完美运行-The ADC converts source code 80C51
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-10
    • 文件大小:1.37kb
    • 提供者:QIQI
  1. permanent-calendar

    0下载:
  2. 用c语言编写万年历程序,日历和时间可以随着时间的变化而变化。-C language calendar program, calendar and time can be changed over time.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:1.37kb
    • 提供者:冬暖夏凉
  1. AT24C02B

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  2. 硬件模块代码,用于片上系统设计仿真验证,完成对AT24C02B的功能和时序模拟
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:1.37kb
    • 提供者:lifeng
  1. F2812_SPWM.rar

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  2. 2812的SPWM程序 基于2812的交流电机SPWM开环调速 以下代码为SPWM开环控制的核心代码,在50HZ交流异步电机调试通过。,2812 SPWM chengxu design hope with you . SPWM Intended for product evaluation purposes DSP28_Example.c
  3. 所属分类:DSP编程

    • 发布日期:2014-05-03
    • 文件大小:1.37kb
    • 提供者:龙峰
  1. timer

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  2. 淺顯易懂的學習verilog程式基礎範例以時鐘為示範-Learn easy to understand the basic Verilog code for an example of a clock model
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.37kb
    • 提供者:劉季泓
  1. SSRAM_CONTROLLER

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  2. sram controller design for GSI sram working
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.37kb
    • 提供者:shreenath
  1. 11

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  2. 基于DS18b20的数字温度计,由液晶显示温度。开发环境Keil.-Based on DS18b20 digital thermometer, the temperature from the liquid crystal display. Development environment Keil.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-09
    • 文件大小:1.37kb
    • 提供者:刘成军
  1. 1

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  2. 将“How are you”通过LCD显示出来,并能够在you前面换行-display how are you on the LCD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.37kb
    • 提供者:王丽华
  1. Traffic-light

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  2. 基于vhdl语言的交通信号灯控制程序,使用软件为Quartus II,硬件为FPGA。-Traffic lights control procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.37kb
    • 提供者:蒙田
  1. uart_rx

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  2. 基于verilog的uart接收模块,16倍波特率采样,具有可选择奇偶校验功能,仿真成功。-Based verilog the uart receiver module, sampling 16 times the baud rate, parity function with selectable, successful simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.37kb
    • 提供者:Liu
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