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  1. AM_Modulation

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  2. Am modulation implement fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:1.24kb
    • 提供者:majid
  1. S2P_TOP

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  2. This file contains the top module which uses the S2P_SM module which is actually a controller. SO by changing in the top module we can use the S2P module completely-This file contains the top module which uses the S2P_SM module which is actually
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.24kb
    • 提供者:Shahzad
  1. test

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  2. 本程序是应用于DSP TMS320VC5416芯片的FLASH读写程序,使用本程序可以对NOR型FLASH进行编程、擦除操作-This procedure is applied to the FLASH chip DSP TMS320VC5416 to read and write, the use of this procedure can be carried out on the NOR-based FLASH program, erase operation
  3. 所属分类:DSP program

    • 发布日期:2017-04-04
    • 文件大小:1.24kb
    • 提供者:东东
  1. lcd1602

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  2. lcd1602的现实程序,可以在屏幕上逐行扫描-lcd1602 the reality of the procedure, you can scan the screen line by line
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.24kb
    • 提供者:刘峰
  1. LCD-hello

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  2. VHDL syntax hello world for LCD written in VHDL MAXII evaluation board EPM1270F256C5
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:1.24kb
    • 提供者:soroush
  1. sdfsdFifo

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  2. 这是一个异步fifo的Verilog 代码,该代码的功能是实现异步的first in first out-This is an asynchronous fifo in the Verilog code, the code' s function is to achieve asynchronous first in first out
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.24kb
    • 提供者:Yongjie
  1. TIMER0

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  2. DSP TMS320F28335用CPU定时器产生1秒中断的程序-The DSP TMS320F28335 1 second interrupt the CPU timer program
  3. 所属分类:DSP program

    • 发布日期:2017-03-30
    • 文件大小:1.24kb
    • 提供者:isabella
  1. int_div

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  2. 任意计数的分频器,实现功能超强;只需改变分频数字而已-frequency divider vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:1.24kb
    • 提供者:gongwenbiao
  1. DSP281x_ADC04U

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  2. 这是dsp的模数转化的一个c语言设计,能够实现A/D转换-Dsp analog-to-digital conversion c language design, can achieve the A/D converter
  3. 所属分类:DSP program

    • 发布日期:2017-11-26
    • 文件大小:1.24kb
    • 提供者:崔久强
  1. fifo

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  2. 一个经典的fifo的Verilog工程实例,相信对初学者会有一定的帮助。-A classic instance of fifo Verilog project, I believe there will be some help for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.24kb
    • 提供者:Carl
  1. CPP_jiecheng

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  2. 用C++实现阶乘运算,简单方便,适合初学者使用-With C++ factorial, simple and convenient, suitable for beginners
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:1.24kb
    • 提供者:zhui2973951
  1. debug

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  2. 模拟串口,可将任意一个IO口作为串口输出进行调试-Simulate serial port can be any one of the IO port as serial output for debugging. . .
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:1.24kb
    • 提供者:张家俊
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