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  1. led_flow

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  2. 利用状态机来实现8为的跑马灯,时间间隔为1S,输入的时钟为50MHz。-Use of state machine 8 in order to Marquee, the time interval for the 1S, the input clock is 50MHz.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:569byte
    • 提供者:仝信
  1. led3

    0下载:
  2. LED流水灯,基于C51单片机,C语言源程序-LED water lamp, based on the C51 single-chip, C language source code
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-07
    • 文件大小:569byte
    • 提供者:libaoyuan
  1. matrix_interleaver

    0下载:
  2. code for s-box and matrix interleaving.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569byte
    • 提供者:kalidas
  1. BCD2LED

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  2. bcd to led decoder file-bcd to led decoder file..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569byte
    • 提供者:praveenkumardr
  1. CHABIAO

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  2. 查表的汇编程序 很适合软件设计的初学者学习-progam of table look-up
  3. 所属分类:Other Embeded program

    • 发布日期:2017-11-27
    • 文件大小:569byte
    • 提供者:honghong
  1. light

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  2. VHDL的简单流水灯程序,实现八段数码管从中间到两边再从两边到中间依次点亮-VHDL simple light water program, eight digital tube from the middle to both sides from both sides to the middle followed by light
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:569byte
    • 提供者:lijiaxi
  1. ps2_keyboard_test

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  2. FPGA通过ps2接收键盘数据,然后把接收到的字母A到Z键值转换相应的ASII码,通过串口发送到PC机上。 实验时,需要接键盘,还要用调试助手,下载程序后,在键盘上按下一个键,比如A,则在PC调试助手上可看到A -FPGA receives data via the keyboard ps2, and then received the letters A through Z keys corresponding conversion ASII code sent to the PC v
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569byte
    • 提供者:jame
  1. FIR_lowpass

    0下载:
  2. FIR低通滤波功能,可实现低频段滤波,效果良好-FIR low-pass filtering function can achieve low frequency filtering, to good effect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569byte
    • 提供者:李佩青
  1. VGA_SYNC

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  2. VGA_SYNC is a part of VGA controller, base d on Spartan 3 chip, use for show bar color picture in screen
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569byte
    • 提供者:yang gao
  1. CRC-code-realization

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  2. 该代码主要用来实现通信中的数据帧里CRC校验功能-The code is used to realize the function of CRC check in telecommunication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:569byte
    • 提供者:徐以为
  1. Delay

    0下载:
  2. Delay routines for milli seconds, seconds in C51
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-12
    • 文件大小:569byte
    • 提供者:venkatesh
  1. ADC_READ

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  2. 读取 模数转换器的数据 把读来的数据存在FIFI中-ADC read,Einlesen der Daten von ADC-Wandler dann in FIFO Speichern
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:569byte
    • 提供者:Aaron
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