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  1. xapp134_vhdl

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  2. The SDRAM controller is designed for the Virtex V300bg432-6. It s simulated with Micron SDRAM models. The design is verified with timing constraints at 115 MHZ.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.51mb
    • 提供者:ronsullivan
  1. 83007VHDL设计实例

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  2. VHDL设计实例 VHDL设计实例
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:40.4kb
    • 提供者:阿发
  1. Verilog

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  2. Verilog语言的基础教程,适合刚开始接触硬件语言的朋友
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:314.36kb
    • 提供者:隋学伟
  1. Altare_VHDL

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  2. Altare公司训练新人的练习题下载 希望能够对学习VHDL的朋友有所帮助
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:52.99kb
    • 提供者:刘英超
  1. verilog2

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  2. verilog语言中 数据类型与逻辑运算关系式
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:204.96kb
    • 提供者:隋学伟
  1. 3verilog3

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  2. verilog语言中的各种赋值语句的详细解释和用法
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:265.1kb
    • 提供者:隋学伟
  1. verilog4

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  2. werilog语言中关于 组合逻辑时序逻辑的表达
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:189.94kb
    • 提供者:隋学伟
  1. verilog5

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  2. verilog语言中 testbencch编写-仿真工具综合工具使用-全加器实例讲解
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:184.82kb
    • 提供者:隋学伟
  1. fip

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  2. 通过PC104访问内存地址,内存需要进行地址选择,需要通过CPLD做地址逻辑变换。这个就是完成这个功能。实现简单。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:661.94kb
    • 提供者:周胜
  1. ram_read_write

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  2. 本程序是为FPGA系统所设计的一个简单的存储和读取数据的小程序,MAXPLUS2编写
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:184.18kb
    • 提供者:youhateme8008
  1. chuankou_data_send

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  2. 这是FPGA系统的一个简单的与上位机串行通讯的的小程序,MAXPLUS2编写
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:98.1kb
    • 提供者:youhateme8008
  1. testled

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  2. 为FPGA系统所设计的一个简单的控制LED灯显示的小程序,用MAXPLUS2编写
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:67.12kb
    • 提供者:youhateme8008
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