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文件名称:Processor_alu

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.46kb
  • 已下载：
    0次
  • 提 供 者：
    Yogesh******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

this Code is in verilog HDL.

This Code is for piplined processor with 4 opcode.

this will work in three cycle latch, decode and exicute..

test bench for xilinx ise is laos given

相关搜索： Verilog processor verilog code for processor processor verilog verilog HDL code for processor Verilog test bench Xilinx ISE Verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

Processor_alu/
Processor_alu/alu_top.v
Processor_alu/alu_control_tbw.tfw
Processor_alu/IF_alu.v
Processor_alu/DC_alu.v
Processor_alu/EX_alu.v
Processor_alu/alu_control.v

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