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文件名称:ADDER

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2012-11-16
  • 文件大小：
    22.15kb
  • 已下载：
    0次
  • 提 供 者：
    pii***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

VHDL语言的带控制端口的加法器，实现加法运算。-VHDL language, with a control port of the adder to achieve addition operation.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ADDER/1_ADDER/1_ADDER.exp
ADDER/1_ADDER/files/L1.rpt
ADDER/1_ADDER/files/L2.rpt
ADDER/1_ADDER/files/L3.rpt
ADDER/1_ADDER/workdirs/aa/ADDER.sim
ADDER/1_ADDER/workdirs/aa/ADDER.syn
ADDER/1_ADDER/workdirs/aa/Anal.info
ADDER/1_ADDER/workdirs/aa/Anal.out
ADDER/1_ADDER/workdirs/WORK/Anal.info
ADDER/1_ADDER/workdirs/WORK/Anal.out
ADDER/1_ADDER/workdirs/WORK/BIT_RTL_ADDER.sim
ADDER/1_ADDER/workdirs/WORK/BIT_RTL_ADDER.syn
ADDER/1_adder.acf
ADDER/1_adder.hif
ADDER/1_adder.mmf
ADDER/1_ADDER.VHD
ADDER/bir_rtl_adder.acf
ADDER/bir_rtl_adder.hif
ADDER/bir_rtl_adder.mmf
ADDER/bir_rtl_adder.tdf
ADDER/bit_rtl_adder.acf
ADDER/bit_rtl_adder.hif
ADDER/bit_rtl_adder.mmf
ADDER/bit_rtl_adder.vhd
ADDER/LIB.DLS
ADDER/README.TXT
ADDER/U2268397.DLS
ADDER/1_ADDER/workdirs/aa
ADDER/1_ADDER/workdirs/WORK
ADDER/1_ADDER/files
ADDER/1_ADDER/workdirs
ADDER/1_ADDER
ADDER

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