文件名称:dual_RAM
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- 上传时间:2012-11-16
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文件大小:1.25kb
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vhdl语言编写的双口ram及testbench,模块可以在modelsim里进行时序和功能仿真。-vhdl language of the dual-port ram, and testbench, modules, conducted in the modelsim timing and functional simulation.
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dualaram_tb.vhd
dualaram.vhd
dualaram.vhd
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