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文件名称:fifo

  • 所属分类：
    Project Design
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    33.71kb
  • 已下载：
    0次
  • 提 供 者：
    toya****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

this verilog program for sysnchronous FIFO ,this document contains some error using before correct and then use,-this is verilog program for　sysnchronous FIFO ,this document contains some error using before correct and then use,
相关搜索： sysnchronous FIFO FIFO verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

fifo/automake.log
fifo/coregen.log
fifo/coregen.prj
fifo/fifo.dhp
fifo/fifo.npl
fifo/FIFO1.ANT
fifo/fifo1.tbw
fifo/FIFO1.TFW
fifo/fifo2.v
fifo/fifo21.v
fifo/fifosyn2.v
fifo/fifosysn1.v
fifo/prjname.lso
fifo/sync_fifo.cmd_log
fifo/sync_fifo.lso
fifo/sync_fifo.ngr
fifo/sync_fifo.prj
fifo/sync_fifo.stx
fifo/sync_fifo.syr
fifo/sync_fifo_vhdl.prj
fifo/synfifo.v
fifo/syn_fifo.cmd_log
fifo/syn_fifo.lso
fifo/syn_fifo.prj
fifo/syn_fifo.syr
fifo/syn_fifo_vhdl.prj
fifo/xst/
fifo/xst/work/
fifo/xst/work/hdllib.ref
fifo/xst/work/vlg20/
fifo/xst/work/vlg20/sync_fifo.bin
fifo/xst/work/vlg29/
fifo/xst/work/vlg29/syn_fifo.bin
fifo/xst/work/vlg31/
fifo/xst/work/vlg31/ram_dp_ar.bin
fifo/__projnav/
fifo/__projnav/coregen.rsp
fifo/__projnav/fifo.gfl
fifo/__projnav/fifo_flowplus.gfl
fifo/__projnav/hb_cmds
fifo/__projnav/runXst_tcl.rsp
fifo/__projnav/sync_fifo.xst
fifo/__projnav/syn_fifo.xst
fifo/__projnav/xst_sprjTOstx_tcl.rsp
fifo/__projnav.log
fifo/

相关说明

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