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文件名称:fifo

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    5.69kb
  • 已下载：
    0次
  • 提 供 者：
    zhulya*******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

fifo用Verilog hdl的实现，这是一个比较常用的源码，文档中有很详细的注释，初学者应该可以看懂。-implementation using Verilog hdl usb, this is a common source, the document had a very detailed notes, beginners should understand.
相关搜索： fifo Verilog USB usb verilog document

(系统自动生成,下载前可以参看下载内容)

下载文件列表

fifo_test/beh_fifo.v
fifo_test/fifo1.v
fifo_test/fifomem.v
fifo_test/log_out.txt
fifo_test/rptr_empty.v
fifo_test/sync_r2w.v
fifo_test/sync_w2r.v
fifo_test/wave.do
fifo_test/wptr_full.v
fifo_test

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