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文件名称:VHDL

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    61.78kb
  • 已下载：
    0次
  • 提 供 者：
    deng *****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

VHDL语言程序设计及应用的源代码。包括2-12章的内容。内有一个应用实例：数字密码引爆器的设计。-VHDL language and application programming source code. Including the contents of Chapter 2-12. There are a practical example: the design of digital code detonator.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

VHDL/Chapter10/example10-1/basic_dff.vhd
VHDL/Chapter10/example10-10/registern.vhd
VHDL/Chapter10/example10-11/shift_regn.vhd
VHDL/Chapter10/example10-12/shift_reg.vhd
VHDL/Chapter10/example10-13/shift_regn.vhd
VHDL/Chapter10/example10-14/shift_regn.vhd
VHDL/Chapter10/example10-15/counter.vhd
VHDL/Chapter10/example10-16/countern.vhd
VHDL/Chapter10/example10-17/countern.vhd
VHDL/Chapter10/example10-18/async_counter.vhd
VHDL/Chapter10/example10-2/sync_rdff.vhd
VHDL/Chapter10/example10-3/async_rdff.vhd
VHDL/Chapter10/example10-4/sync_rsdff.vhd
VHDL/Chapter10/example10-5/async_rsdff.vhd
VHDL/Chapter10/example10-6/async_rsjkff.vhd
VHDL/Chapter10/example10-7/tff.vhd
VHDL/Chapter10/example10-8/latch_74ls373.vhd
VHDL/Chapter10/example10-9/reg_74ls374.vhd
VHDL/Chapter11/example11-1/store_controller.vhd
VHDL/Chapter11/example11-10/store_controller.vhd
VHDL/Chapter11/example11-11/store_controller.vhd
VHDL/Chapter11/example11-2/store_controller.vhd
VHDL/Chapter11/example11-3/store_controller.vhd
VHDL/Chapter11/example11-4/store_controller.vhd
VHDL/Chapter11/example11-5/store_controller.vhd
VHDL/Chapter11/example11-6/store_controller.vhd
VHDL/Chapter11/example11-7/store_controller.vhd
VHDL/Chapter11/example11-8/store_controller.vhd
VHDL/Chapter11/example11-9/store_controller.vhd
VHDL/Chapter12/example12-1&2/fire_d.vhd
VHDL/Chapter12/example12-10/kcoun102.vhd
VHDL/Chapter12/example12-11/kcoun10.vhd
VHDL/Chapter12/example12-12/kcoun20.vhd
VHDL/Chapter12/example12-13/se7.vhd
VHDL/Chapter12/example12-14/kinvert.vhd
VHDL/Chapter12/example12-15/control.vhd
VHDL/Chapter12/example12-3/ksy.vhd
VHDL/Chapter12/example12-4/kbian.vhd
VHDL/Chapter12/example12-5/kcom.vhd
VHDL/Chapter12/example12-6/k4mux.vhd
VHDL/Chapter12/example12-7/kcount.vhd
VHDL/Chapter12/example12-8/kf_f.vhd
VHDL/Chapter12/example12-9/kcoun101.vhd
VHDL/Chapter2/example2-1/and_gate.vhd
VHDL/Chapter3/example3-1/counter.vhd
VHDL/Chapter3/example3-2/and_gate.vhd
VHDL/Chapter3/example3-3/and_gate4.vhd
VHDL/Chapter3/example3-4/adder.vhd
VHDL/Chapter3/example3-5/full_adder.vhd
VHDL/Chapter3/example3-6/full_adder.vhd
VHDL/Chapter3/example3-7/half_adder.vhd
VHDL/Chapter3/example3-8/full_adder.vhd
VHDL/Chapter4/example4-1/mux2.vhd
VHDL/Chapter4/example4-10/vector_to_int.vhd
VHDL/Chapter4/example4-11/example.vhd
VHDL/Chapter4/example4-12/comparison.vhd
VHDL/Chapter4/example4-13/example.vhd
VHDL/Chapter4/example4-14/max.vhd
VHDL/Chapter4/example4-15/example.vhd
VHDL/Chapter4/example4-16/max.vhd
VHDL/Chapter4/example4-17/example.vhd
VHDL/Chapter4/example4-2/dff.vhd
VHDL/Chapter4/example4-3/full_adder.vhd
VHDL/Chapter4/example4-4/cpu.vhd
VHDL/Chapter4/example4-5/dff.vhd
VHDL/Chapter4/example4-6/sync_communication.vhd
VHDL/Chapter4/example4-7/vector_to_int.vhd
VHDL/Chapter4/example4-8/example.vhd
VHDL/Chapter4/example4-9/convert.vhd
VHDL/Chapter5/example5-1/bus_and.vhd
VHDL/Chapter5/example5-10/mux4.vhd
VHDL/Chapter5/example5-11/mux4.vhd
VHDL/Chapter5/example5-12/vector_to_int.vhd
VHDL/Chapter5/example5-13/logic_and.vhd
VHDL/Chapter5/example5-14/logic_and.vhd
VHDL/Chapter5/example5-15/maximum.vhd
VHDL/Chapter5/example5-16/mux4.vhd
VHDL/Chapter5/example5-17/rsff.vhd
VHDL/Chapter5/example5-2/bus_and.vhd
VHDL/Chapter5/example5-3/reset_dff1.vhd
VHDL/Chapter5/example5-4/reset_dff2.vhd
VHDL/Chapter5/example5-5/clk_generator.vhd
VHDL/Chapter5/example5-6/example.vhd
VHDL/Chapter5/example5-7/example.vhd
VHDL/Chapter5/example5-8/adder.vhd
VHDL/Chapter5/example5-9/mux2.vhd
VHDL/Chapter6/example6-1/gate_circuits.vhd
VHDL/Chapter6/example6-10/example.vhd
VHDL/Chapter6/example6-11/shift_reg.vhd
VHDL/Chapter6/example6-12/shift_reg.vhd
VHDL/Chapter6/example6-13/shift_reg.vhd
VHDL/Chapter6/example6-2/gate_circuits.vhd
VHDL/Chapter6/example6-3/and_gate.vhd
VHDL/Chapter6/example6-4/and_gate.vhd
VHDL/Chapter6/example6-5/mux4.vhd
VHDL/Chapter6/example6-6/example.vhd
VHDL/Chapter6/example6-7/example.vhd
VHDL/Chapter6/example6-8/and_gate.vhd
VHDL/Chapter6/example6-9/example.vhd
VHDL/Chapter7/example7-1/vector_to_int.vhd
VHDL/Chapter7/example7-10/vector_to_int.vhd
VHDL/Chapter7/example7-2/vector_to_int.vhd
VHDL/Chapter7/example7-3/and4.vhd
VHDL/Chapter7/example7-4/ram.vhd
VHDL/Chapter7/example7-5/dff.vhd
VHDL/Chapter7/example7-6/dff.vhd
VHDL/Chapter7/example7-7/dff.vhd
VHDL/Chapter7/example7-8/dff.vhd
VHDL/Chapter7/example7-9/dff.vhd
VHDL/Chapter8/example8-1/example.vhd
VHDL/Chapter8/example8-2/full_adder.vhd
VHDL/Chapter8/example8-3/full_adder.vhd
VHDL/Chapter9/example9-1/and2_gate.vhd
VHDL/Chapter9/example9-10/pri_encoder.vhd
VHDL/Chapter9/example9-11/decoder_74ls138.vhd
VHDL/Chapter9/example9-12/decoder8421_10.vhd
VHDL/Chapter9/example9-13/mux4.vhd
VHDL/Chapter9/example9-14/addern.vhd
VHDL/Chapter9/example9-15/equal_comp4.vhd
VHDL/Chapter9/example9-16/comparison.vhd
VHDL/Chapter9/example9-2/and2_gate.vhd
VHDL/Chapter9/example9-3/basic_gate.vhd
VHDL/Chapter9/example9-4/and3_gate.vhd
VHDL/Chapter9/example9-5/and3_gate.vhd
VHDL/Chapter9/example9-6/and3_gate.vhd
VHDL/Chapter9/example9-7/tri_gate.vhd
VHDL/Chapter9/example9-8/bidir_bus_buff8.vhd
VHDL/Chapter9/example9-9/encoder8_3.vhd
VHDL/Chapter10/example10-1
VHDL/Chapt

相关说明

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