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文件名称:states

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    168.84kb
  • 已下载：
    0次
  • 提 供 者：
    平***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

数字钟是一个实用而简单的独立设计，但是根据不同的做法，变化和功能很多，数字钟设计到分频，计数，状态转换，进制转换，和特殊情况处理等。设计应该由易到难，先设计一个简单的数字钟，然后进行功能扩充。数字钟无论如何变化，都是一个独立芯片自成系统，不需要和其他的智能芯片进行通讯。本程序主要实现简单的计时功能。-Digital clock is a practical and simple for independent design, but according to different practices, changes and a lot of functions, designed to the sub-frequency digital clock, counting, state transition, binary conversion, and processing Deng special circumstances. Design should be easy to difficult, first to design a simple digital clock, and then expand the functionality. Digital clock in any case, is a separate chip, as a system, do not need, and other smart chip to communicate. This procedure mainly simple time-keeping.


(系统自动生成,下载前可以参看下载内容)

下载文件列表

states/db/add_sub_lnh.tdf
states/db/add_sub_pnh.tdf
states/db/mux_19c.tdf
states/db/states.(0).cnf.cdb
states/db/states.(0).cnf.hdb
states/db/states.(1).cnf.cdb
states/db/states.(1).cnf.hdb
states/db/states.analyze_file.qmsg
states/db/states.asm.qmsg
states/db/states.cbx.xml
states/db/states.cmp.cdb
states/db/states.cmp.hdb
states/db/states.cmp.qrpt
states/db/states.cmp.rdb
states/db/states.cmp.tdb
states/db/states.cmp0.ddb
states/db/states.dbp
states/db/states.db_info
states/db/states.eco.cdb
states/db/states.eds_overflow
states/db/states.fit.qmsg
states/db/states.fnsim.cdb
states/db/states.fnsim.hdb
states/db/states.fnsim.qmsg
states/db/states.hier_info
states/db/states.hif
states/db/states.map.cdb
states/db/states.map.hdb
states/db/states.map.qmsg
states/db/states.pre_map.cdb
states/db/states.pre_map.hdb
states/db/states.psp
states/db/states.rtlv.hdb
states/db/states.rtlv_sg.cdb
states/db/states.rtlv_sg_swap.cdb
states/db/states.sgdiff.cdb
states/db/states.sgdiff.hdb
states/db/states.sim.hdb
states/db/states.sim.qmsg
states/db/states.sim.qrpt
states/db/states.sim.rdb
states/db/states.sim.vwf
states/db/states.sld_design_entry.sci
states/db/states.sld_design_entry_dsc.sci
states/db/states.syn_hier_info
states/db/states.tan.qmsg
states/states.asm.rpt
states/states.done
states/states.fit.eqn
states/states.fit.rpt
states/states.fit.summary
states/states.flow.rpt
states/states.map.eqn
states/states.map.rpt
states/states.map.summary
states/states.pin
states/states.pof
states/states.qpf
states/states.qsf
states/states.qws
states/states.sim.rpt
states/states.tan.rpt
states/states.tan.summary
states/states.vhd
states/states07022021.vwf
states/talkback/states.asm.talkback.xml
states/talkback/states.fit.talkback.xml
states/talkback/states.map.talkback.xml
states/talkback/states.sim.talkback.xml
states/talkback/states.tan.talkback.xml
states/db
states/talkback
states

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