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文件名称:uart

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    919.57kb
  • 已下载：
    0次
  • 提 供 者：
    张***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于verilog HDL编写的串口通讯接口uart程序-Prepared based on verilog HDL uart serial communication interface program
(系统自动生成,下载前可以参看下载内容)

下载文件列表

uart_regs/core/myfifo_10.v
uart_regs/core/myfifo_10_bb.v
uart_regs/core/myfifo_10_wave0.jpg
uart_regs/core/myfifo_10_waveforms.html
uart_regs/core/myfifo_8.v
uart_regs/core/myfifo_8_bb.v
uart_regs/core/myfifo_8_wave0.jpg
uart_regs/core/myfifo_8_waveforms.html
uart_regs/dev/chip_editor.acv
uart_regs/dev/cmp_state.ini
uart_regs/dev/db/add_sub_1jh.tdf
uart_regs/dev/db/add_sub_dhh.tdf
uart_regs/dev/db/add_sub_ehh.tdf
uart_regs/dev/db/add_sub_fhh.tdf
uart_regs/dev/db/add_sub_ihh.tdf
uart_regs/dev/db/add_sub_rih.tdf
uart_regs/dev/db/altsyncram_apb1.tdf
uart_regs/dev/db/altsyncram_mmb1.tdf
uart_regs/dev/db/a_dpfifo_4nl.tdf
uart_regs/dev/db/a_dpfifo_rll.tdf
uart_regs/dev/db/a_fefifo_qve.tdf
uart_regs/dev/db/dpram_81k.tdf
uart_regs/dev/db/dpram_h2k.tdf
uart_regs/dev/db/scfifo_eaq.tdf
uart_regs/dev/db/scfifo_nbq.tdf
uart_regs/dev/db/uart_regs(0).cnf.cdb
uart_regs/dev/db/uart_regs(0).cnf.hdb
uart_regs/dev/db/uart_regs(1).cnf.cdb
uart_regs/dev/db/uart_regs(1).cnf.hdb
uart_regs/dev/db/uart_regs(10).cnf.cdb
uart_regs/dev/db/uart_regs(10).cnf.hdb
uart_regs/dev/db/uart_regs(11).cnf.cdb
uart_regs/dev/db/uart_regs(11).cnf.hdb
uart_regs/dev/db/uart_regs(12).cnf.cdb
uart_regs/dev/db/uart_regs(12).cnf.hdb
uart_regs/dev/db/uart_regs(13).cnf.cdb
uart_regs/dev/db/uart_regs(13).cnf.hdb
uart_regs/dev/db/uart_regs(14).cnf.cdb
uart_regs/dev/db/uart_regs(14).cnf.hdb
uart_regs/dev/db/uart_regs(15).cnf.cdb
uart_regs/dev/db/uart_regs(15).cnf.hdb
uart_regs/dev/db/uart_regs(16).cnf.cdb
uart_regs/dev/db/uart_regs(16).cnf.hdb
uart_regs/dev/db/uart_regs(17).cnf.cdb
uart_regs/dev/db/uart_regs(17).cnf.hdb
uart_regs/dev/db/uart_regs(18).cnf.cdb
uart_regs/dev/db/uart_regs(18).cnf.hdb
uart_regs/dev/db/uart_regs(19).cnf.cdb
uart_regs/dev/db/uart_regs(19).cnf.hdb
uart_regs/dev/db/uart_regs(2).cnf.cdb
uart_regs/dev/db/uart_regs(2).cnf.hdb
uart_regs/dev/db/uart_regs(20).cnf.cdb
uart_regs/dev/db/uart_regs(20).cnf.hdb
uart_regs/dev/db/uart_regs(21).cnf.cdb
uart_regs/dev/db/uart_regs(21).cnf.hdb
uart_regs/dev/db/uart_regs(3).cnf.cdb
uart_regs/dev/db/uart_regs(3).cnf.hdb
uart_regs/dev/db/uart_regs(4).cnf.cdb
uart_regs/dev/db/uart_regs(4).cnf.hdb
uart_regs/dev/db/uart_regs(5).cnf.cdb
uart_regs/dev/db/uart_regs(5).cnf.hdb
uart_regs/dev/db/uart_regs(6).cnf.cdb
uart_regs/dev/db/uart_regs(6).cnf.hdb
uart_regs/dev/db/uart_regs(7).cnf.cdb
uart_regs/dev/db/uart_regs(7).cnf.hdb
uart_regs/dev/db/uart_regs(8).cnf.cdb
uart_regs/dev/db/uart_regs(8).cnf.hdb
uart_regs/dev/db/uart_regs(9).cnf.cdb
uart_regs/dev/db/uart_regs(9).cnf.hdb
uart_regs/dev/db/uart_regs-sim.vwf
uart_regs/dev/db/uart_regs.asm.qmsg
uart_regs/dev/db/uart_regs.cmp.cdb
uart_regs/dev/db/uart_regs.cmp.hdb
uart_regs/dev/db/uart_regs.cmp.rdb
uart_regs/dev/db/uart_regs.csf.qmsg
uart_regs/dev/db/uart_regs.db_info
uart_regs/dev/db/uart_regs.fit.qmsg
uart_regs/dev/db/uart_regs.fld
uart_regs/dev/db/uart_regs.fnsim.cdb
uart_regs/dev/db/uart_regs.fnsim.hdb
uart_regs/dev/db/uart_regs.hif
uart_regs/dev/db/uart_regs.icc
uart_regs/dev/db/uart_regs.map.cdb
uart_regs/dev/db/uart_regs.map.hdb
uart_regs/dev/db/uart_regs.map.qmsg
uart_regs/dev/db/uart_regs.pre_map.hdb
uart_regs/dev/db/uart_regs.project.hdb
uart_regs/dev/db/uart_regs.rpp.qmsg
uart_regs/dev/db/uart_regs.rtlv.hdb
uart_regs/dev/db/uart_regs.rtlv_rvd.rvd
uart_regs/dev/db/uart_regs.rtlv_sg.cdb
uart_regs/dev/db/uart_regs.rtlv_sg_swap.cdb
uart_regs/dev/db/uart_regs.sgdiff.cdb
uart_regs/dev/db/uart_regs.sgdiff.hdb
uart_regs/dev/db/uart_regs.signalprobe.cdb
uart_regs/dev/db/uart_regs.sim.hdb
uart_regs/dev/db/uart_regs.sim.qmsg
uart_regs/dev/db/uart_regs.sim.rdb
uart_regs/dev/db/uart_regs.tan.qmsg
uart_regs/dev/db/uart_regs.uart_regs.sld_design_entry.sci
uart_regs/dev/db/uart_regs_cmp.qrpt
uart_regs/dev/db/uart_regs_hier_info
uart_regs/dev/db/uart_regs_sim.qrpt
uart_regs/dev/db/uart_regs_syn_hier_info
uart_regs/dev/sim.cfg
uart_regs/dev/uart_regs.asm.rpt
uart_regs/dev/uart_regs.done
uart_regs/dev/uart_regs.fit.eqn
uart_regs/dev/uart_regs.fit.rpt
uart_regs/dev/uart_regs.fld
uart_regs/dev/uart_regs.flow.rpt
uart_regs/dev/uart_regs.map.eqn
uart_regs/dev/uart_regs.map.rpt
uart_regs/dev/uart_regs.pin
uart_regs/dev/uart_regs.pof
uart_regs/dev/uart_regs.qpf
uart_regs/dev/uart_regs.qsf
uart_regs/dev/uart_regs.qws
uart_regs/dev/uart_regs.rbf
uart_regs/dev/uart_regs.sim.rpt
uart_regs/dev/uart_regs.sof
uart_regs/dev/uart_regs.tan.rpt
uart_regs/dev/uart_regs.tan.summary
uart_regs/sim/funcsim/uart_regs_h.vwf
uart_regs/sim/funcsim/uart_regs_pre.vwf
uart_regs/src/sch/lpm_mux0.bsf
uart_regs/src/sch/lpm_mux0.v
uart_regs/src/sch/lpm_mux0_bb.v
uart_regs/src/sch/sch_exam.bdf
uart_regs/src/seriesPort.v
uart_regs/src/uart_defines.v
uart_regs/src/uart_receiver.v
uart_regs/src/uart_regs.v
uart_regs/src/uart_transmitter.v
uart_regs/src/sch/db
uart_regs/core/db
uart_regs/dev/db
uart_regs/sim/funcsim
uart_regs/sim/parsim
uart_regs/src/sch
uart_regs/core
uart_regs/dev
uart_regs/sim
uart_regs/src
uart_regs

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