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文件名称:series_port

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.85kb
  • 已下载：
    0次
  • 提 供 者：
    小***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog语言编写的串口收发程序，可以进行429总线数据与rs232口的通信。-With verilog program written in serial transceivers, can be 429 bus data and rs232 mouth communication.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

串口收发/clockdiv.v
串口收发/toptest.v
串口收发/top.v
串口收发/reciever.v
串口收发/transmit.v
串口收发/recie_test.v
串口收发

相关说明

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