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文件名称:altera_de2_vhdl

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2012-11-16
  • 文件大小：
    576.4kb
  • 已下载：
    0次
  • 提 供 者：
    can****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

Tutorial of VHDL with Altera DE2 board: quartus II and DE2 board The target do the BCD sum of input data coded with the

switches and display the result on 7 segment display
相关搜索： target altera

(系统自动生成,下载前可以参看下载内容)

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altera_de2_vhdl/
altera_de2_vhdl/test_sum_mux.qsf
altera_de2_vhdl/incremental_db/
altera_de2_vhdl/incremental_db/README
altera_de2_vhdl/incremental_db/compiled_partitions/
altera_de2_vhdl/incremental_db/compiled_partitions/test_sum_mux.root_partition.map.kpt
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altera_de2_vhdl/test_sum_mux.vhd
altera_de2_vhdl/test_sum_mux.pin
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altera_de2_vhdl/test_sum_mux.done
altera_de2_vhdl/test_sum_mux.vhd.bak
altera_de2_vhdl/test_sum_mux.map.summary
altera_de2_vhdl/test_sum_mux.qpf
altera_de2_vhdl/test_sum_mux.sof
altera_de2_vhdl/test_sum_mux.qsf.bak
altera_de2_vhdl/test_sum_mux.qws
altera_de2_vhdl/test_sum_mux.fit.summary
altera_de2_vhdl/test_sum_mux.map.rpt
altera_de2_vhdl/test_sum_mux.fit.rpt
altera_de2_vhdl/test_sum_mux.tan.rpt
altera_de2_vhdl/test_sum_mux.pof

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