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文件名称:ads774

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    172.9kb
  • 已下载：
    0次
  • 提 供 者：
    5156*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog编写的ADS774控制程序,由于ADS774数字量输出不稳定,建议取平均值-control program written in verilog ADS774, ADS774 digital output as unstable, the proposed averaging
相关搜索： ads774 averaging 平均 verilog

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ads774/incremental_db/compiled_partitions
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ads774/incremental_db
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