文件名称:CLK_DIV
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- 上传时间:2012-11-16
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用来产生一个电路的基准的时钟信号,并可以以此为基准产生其他与此时钟信号成倍数时钟信号-Used to generate a reference clock signal circuit and can produce this as a reference clock signal into the other and the clock multiplier
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CLK_DIV.VHD
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