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文件名称:dfilter

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    15.7mb
  • 已下载:
    0次
  • 提 供 者:
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

用FPGA实现信道化接收机算法,共256个信道,处理时钟40M,时分复用完成算法实现-FPGA implementation using channelized receiver algorithm, a total of 256 channels, processing clock 40M, time division multiplexing algorithm to complete
相关搜索: 接收机 信道化

(系统自动生成,下载前可以参看下载内容)

下载文件列表

dfilter/.lso
dfilter/ddc.v
dfilter/ddc_dfil.v
dfilter/ddc_dfil_summary.html
dfilter/delay.v
dfilter/delay_14.v
dfilter/delay_2.v
dfilter/dfilter.bgn
dfilter/dfilter.bld
dfilter/dfilter.cmd_log
dfilter/dfilter.ise
dfilter/dfilter.ise_ISE_Backup
dfilter/dfilter.lso
dfilter/dfilter.ncd
dfilter/dfilter.ngc
dfilter/dfilter.ngd
dfilter/dfilter.ngr
dfilter/dfilter.ntrc_log
dfilter/dfilter.pad
dfilter/dfilter.par
dfilter/dfilter.pcf
dfilter/dfilter.prj
dfilter/dfilter.stx
dfilter/dfilter.syr
dfilter/dfilter.twr
dfilter/dfilter.twx
dfilter/dfilter.unroutes
dfilter/dfilter.ut
dfilter/dfilter.v
dfilter/dfilter.xpi
dfilter/dfilter.xst
dfilter/dfilter_guide.ncd
dfilter/dfilter_map.map
dfilter/dfilter_map.mrp
dfilter/dfilter_map.ncd
dfilter/dfilter_map.ngm
dfilter/dfilter_modelsim/ddc_dfilter仿真图.doc
dfilter/dfilter_modelsim/modelsim wave.doc
dfilter/dfilter_modelsim/vsim.wlf
dfilter/dfilter_modelsim/wave.do
dfilter/dfilter_pad.csv
dfilter/dfilter_pad.txt
dfilter/dfilter_prev_built.ngd
dfilter/dfilter_summary.html
dfilter/dfilter_summary.xml
dfilter/dfilter_test.v
dfilter/dfilter_test_v.tdo
dfilter/dfilter_test_v.udo
dfilter/dfilter_test_v_isim_par.exe
dfilter/dfilter_test_v_par.prj
dfilter/dfilter_test_v_stx.prj
dfilter/dfilter_usage.xml
dfilter/extract.v
dfilter/fifo512.v
dfilter/fifo_22.v
dfilter/fifo_con.v
dfilter/inverce.v
dfilter/isim/simprim_ver.auxlib/ffsrce/ffsrce.h
dfilter/isim/simprim_ver.auxlib/ffsrce/mingw/ffsrce.obj
dfilter/isim/simprim_ver.auxlib/hdllib.ref
dfilter/isim/simprim_ver.auxlib/mux/mingw/mux.obj
dfilter/isim/simprim_ver.auxlib/mux/mux.h
dfilter/isim/simprim_ver.auxlib/sffsrce/mingw/sffsrce.obj
dfilter/isim/simprim_ver.auxlib/sffsrce/sffsrce.h
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__clock__divide__by__2/mingw/x__dcm__adv__clock__divide__by__2.obj
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__clock__divide__by__2/x__dcm__adv__clock__divide__by__2.h
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__clock__lost/mingw/x__dcm__adv__clock__lost.obj
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__clock__lost/x__dcm__adv__clock__lost.h
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__maximum__period__check/mingw/x__dcm__adv__maximum__period__check.obj
dfilter/isim/simprim_ver.auxlib/x__dcm__adv__maximum__period__check/x__dcm__adv__maximum__period__check.h
dfilter/isim/simprim_ver.auxlib/_x___a_n_d2/mingw/_x___a_n_d2.obj
dfilter/isim/simprim_ver.auxlib/_x___a_n_d2/_x___a_n_d2.h
dfilter/isim/simprim_ver.auxlib/_x___a_r_a_m_b36___i_n_t_e_r_n_a_l/mingw/_x___a_r_a_m_b36___i_n_t_e_r_n_a_l.obj
dfilter/isim/simprim_ver.auxlib/_x___a_r_a_m_b36___i_n_t_e_r_n_a_l/_x___a_r_a_m_b36___i_n_t_e_r_n_a_l.h
dfilter/isim/simprim_ver.auxlib/_x___b_u_f/mingw/_x___b_u_f.obj
dfilter/isim/simprim_ver.auxlib/_x___b_u_f/_x___b_u_f.h
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dfilter/isim/simprim_ver.auxlib/_x___d_c_m___a_d_v/mingw/_x___d_c_m___a_d_v.obj
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dfilter/isim/simprim_ver.auxlib/_x___f_f/_x___f_f.h
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dfilter/isim/simprim_ver.auxlib/_x___s_f_f/_x___s_f_f.h
dfilter/isim/simprim_ver.auxlib/_x___s_r_l_c16_e/mingw/_x___s_r_l_c16_e.obj
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dfilter/isim/simprim_ver.auxlib/_x___x_o_r2/mingw/_x___x_o_r2.obj
dfilter/isim/simprim_ver.auxlib/_x___x_o_r2/_x___x_o_r2.h
dfilter/isim/simprim_ver.auxlib/_x___z_e_r_o/mingw/_x___z_e_r_o.obj
dfilter/isim/simprim_ver.auxlib/_x___z_e_r_o/_x___z_e_r_o.h
dfilter/isim/temp/hdllib.ref
dfilter/i

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