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文件名称:FPGA-VHDL-dengjingduc

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    274.12kb
  • 已下载：
    0次
  • 提 供 者：
    筱***
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    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本文介绍了基于VHDL语言的十进制等精度频率计的设计，采用VHDL 语言，运用自顶向下的设计思想，将系统按功能逐层分割的层次化设计方法，使用Quartus8.0开发环境，实现了频率计的设计。

-This article describes the decimal-based VHDL, and other precision frequency meter design, using VHDL language, the use of top-down design, the system is divided by function layer hierarchical design method, the use of Quartus8.0 development environment, implemented frequency meter design.
相关搜索： 等精度频率计的设计

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基于FPGA VHDL语言的等精度频率测量/CLK_DIV.bsf
基于FPGA VHDL语言的等精度频率测量/CLK_DIV.inc
基于FPGA VHDL语言的等精度频率测量/CLK_DIV.vhd
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基于FPGA VHDL语言的等精度频率测量/db/add_sub_mkc.tdf
基于FPGA VHDL语言的等精度频率测量/db/alt_u_div_06f.tdf
基于FPGA VHDL语言的等精度频率测量/db/alt_u_div_c5f.tdf
基于FPGA VHDL语言的等精度频率测量/db/alt_u_div_k2f.tdf
基于FPGA VHDL语言的等精度频率测量/db/alt_u_div_k5f.tdf
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基于FPGA VHDL语言的等精度频率测量/db/lpm_divide_9vp.tdf
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基于FPGA VHDL语言的等精度频率测量/db
基于FPGA VHDL语言的等精度频率测量

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