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文件名称:72

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    8.3kb
  • 已下载：
    0次
  • 提 供 者：
    g*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

7:2乘法器 ，应用verilog语言 ，快速高效，使用了华莱士树-Dragging on time-multiplier, application verilog language, fast and efficient, the use of the Wallace tree
(系统自动生成,下载前可以参看下载内容)

下载文件列表

7：2/adder13_12_12.v
7：2/adder13_12_12.v.bak
7：2/adder14_7_7.v.bak
7：2/adder3_2_2.v
7：2/adder3_2_2.v.bak
7：2/adder3_3_3.v
7：2/adder3_3_3.v.bak
7：2/adder9_8_8.v
7：2/adder9_8_8.v.bak
7：2/mul14_7_7.v
7：2/mux22.v
7：2/mux22.v.bak
7：2/mux32.v
7：2/mux32.v.bak
7：2/mux43.v
7：2/mux43.v.bak
7：2/mux53.v
7：2/mux53.v.bak
7：2/mux63.v
7：2/mux63.v.bak
7：2/mux73.v
7：2/mux73.v.bak
7：2/test.v
7：2/test.v.bak
7：2

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