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文件名称:AHB_to_Wishbone_Verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.98mb
  • 已下载：
    0次
  • 提 供 者：
    jin***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该源代码包是AHB总线到Wishbone总线的交接器，包括以下4个部分：RTL源代码，测试平台，软件测试程序，说明文档。-This source package is the AHB bus to Wishbone bus bridge(wrapper).It has the following 4 parts: RTL codes, testbench, software simulating files, help documents.
相关搜索： AHB Wishbone wishbone to ahb wishbone

(系统自动生成,下载前可以参看下载内容)

下载文件列表

AHB_to_Wishbone_Verilog/bench/ahb2wb_tb.v
AHB_to_Wishbone_Verilog/doc/ahb_doc.doc
AHB_to_Wishbone_Verilog/doc/ahb_doc.pdf
AHB_to_Wishbone_Verilog/doc/ahb_doc.sxw
AHB_to_Wishbone_Verilog/sim/modelsim.ini
AHB_to_Wishbone_Verilog/sim/run.mti
AHB_to_Wishbone_Verilog/src/ahb2wb.v
AHB_to_Wishbone_Verilog/bench
AHB_to_Wishbone_Verilog/doc
AHB_to_Wishbone_Verilog/sim
AHB_to_Wishbone_Verilog/src
AHB_to_Wishbone_Verilog

相关说明

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