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文件名称:DDR-SDRAM

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2012-11-16
  • 文件大小：
    52.91kb
  • 已下载：
    0次
  • 提 供 者：
    s****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本应用指南描述了在 Virtex™ -4 XC4VLX25 FF668 -10C 器件中实现的 DDR SDRAM 控制器。该实现运用了直接时钟控制技术来实现数据采集，并采用自动校准电路来调整数据线上的延迟。-This application note describes a Virtex ™ -4 XC4VLX25 FF668-10C to implement the DDR SDRAM device controller. The clock control to achieve use of technology to achieve direct data acquisition, and automatic calibration circuit to adjust the data in line delay.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

DDR SDRAM/
DDR SDRAM/DDR SDRAM/
DDR SDRAM/DDR SDRAM/DDR SDRAM/
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top.txt
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DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_backend_fifos_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_backend_rom_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_cmp_rd_data_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_controller_iobs_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_data_gen_16.txt
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DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_data_path_iobs_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_data_tap_inc.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_data_write_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_ddr_controller_0.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_idelay_ctrl.txt
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DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_infrastructure_iobs_0.txt
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DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_v4_dm_iob.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_v4_dqs_iob.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_v4_dq_iob.txt
DDR SDRAM/DDR SDRAM/DDR SDRAM/mem_interface_top_wr_data_fifo_16.txt

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