文件名称:ISE_lab5
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所属分类：
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- 上传时间：2012-11-16
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使用VHDL 语言编写7 段数码管显示程序，
掌握数码管的驱动方法。使用USB 电缆或并口下载线下载逻辑电路到FPGA，并
调试电路使其正常工作。-Using the VHDL language 7-segment display program, for digital control of the driving method. Using the USB cable or parallel port download cable to download logic to FPGA, and debug the circuit to work properly.
掌握数码管的驱动方法。使用USB 电缆或并口下载线下载逻辑电路到FPGA，并
调试电路使其正常工作。-Using the VHDL language 7-segment display program, for digital control of the driving method. Using the USB cable or parallel port download cable to download logic to FPGA, and debug the circuit to work properly.
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clk7seg_top.vhd
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