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文件名称:Abus_fifo_ram_V1

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    697byte
  • 已下载：
    0次
  • 提 供 者：
    杨***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该模块是基于verilog语言编写的双口ram模块，可将该该模块作为缓存模块使用-surpost ram write/read
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Abus_fifo_ram_V1/Abus_fifo_ram_V1.v
Abus_fifo_ram_V1

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