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文件名称:clkdivverilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    155.69kb
  • 已下载：
    0次
  • 提 供 者：
    ke***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

Verilog的时钟分频程序 基于EPM240的入门实验 特权同学-Verilog program the clock frequency of entry based on experimental privileged students EPM240
(系统自动生成,下载前可以参看下载内容)

下载文件列表

EX1/clkdivverilog/clkdiv.asm.rpt
EX1/clkdivverilog/clkdiv.cdf
EX1/clkdivverilog/clkdiv.done
EX1/clkdivverilog/clkdiv.dpf
EX1/clkdivverilog/clkdiv.fit.rpt
EX1/clkdivverilog/clkdiv.fit.smsg
EX1/clkdivverilog/clkdiv.fit.summary
EX1/clkdivverilog/clkdiv.flow.rpt
EX1/clkdivverilog/clkdiv.map.rpt
EX1/clkdivverilog/clkdiv.map.summary
EX1/clkdivverilog/clkdiv.pin
EX1/clkdivverilog/clkdiv.pof
EX1/clkdivverilog/clkdiv.qpf
EX1/clkdivverilog/clkdiv.qsf
EX1/clkdivverilog/clkdiv.qws
EX1/clkdivverilog/clkdiv.tan.rpt
EX1/clkdivverilog/clkdiv.tan.summary
EX1/clkdivverilog/clkdiv.v
EX1/clkdivverilog/clkdiv.v.bak
EX1/clkdivverilog/clkdiv_assignment_defaults.qdf
EX1/clkdivverilog/sopc_builder_debug_log.txt
EX1/clkdivverilog/incremental_db/README
EX1/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.kpt
EX1/clkdivverilog/db/clkdiv.(0).cnf.cdb
EX1/clkdivverilog/db/clkdiv.(0).cnf.hdb
EX1/clkdivverilog/db/clkdiv.asm.qmsg
EX1/clkdivverilog/db/clkdiv.asm_labs.ddb
EX1/clkdivverilog/db/clkdiv.cbx.xml
EX1/clkdivverilog/db/clkdiv.cmp.cdb
EX1/clkdivverilog/db/clkdiv.cmp.hdb
EX1/clkdivverilog/db/clkdiv.cmp.kpt
EX1/clkdivverilog/db/clkdiv.cmp.logdb
EX1/clkdivverilog/db/clkdiv.cmp.rdb
EX1/clkdivverilog/db/clkdiv.cmp.tdb
EX1/clkdivverilog/db/clkdiv.cmp0.ddb
EX1/clkdivverilog/db/clkdiv.db_info
EX1/clkdivverilog/db/clkdiv.eco.cdb
EX1/clkdivverilog/db/clkdiv.fit.qmsg
EX1/clkdivverilog/db/clkdiv.hier_info
EX1/clkdivverilog/db/clkdiv.hif
EX1/clkdivverilog/db/clkdiv.lpc.html
EX1/clkdivverilog/db/clkdiv.lpc.rdb
EX1/clkdivverilog/db/clkdiv.lpc.txt
EX1/clkdivverilog/db/clkdiv.map.cdb
EX1/clkdivverilog/db/clkdiv.map.hdb
EX1/clkdivverilog/db/clkdiv.map.logdb
EX1/clkdivverilog/db/clkdiv.map.qmsg
EX1/clkdivverilog/db/clkdiv.pre_map.cdb
EX1/clkdivverilog/db/clkdiv.pre_map.hdb
EX1/clkdivverilog/db/clkdiv.rtlv.hdb
EX1/clkdivverilog/db/clkdiv.rtlv_sg.cdb
EX1/clkdivverilog/db/clkdiv.rtlv_sg_swap.cdb
EX1/clkdivverilog/db/clkdiv.sgdiff.cdb
EX1/clkdivverilog/db/clkdiv.sgdiff.hdb
EX1/clkdivverilog/db/clkdiv.sld_design_entry.sci
EX1/clkdivverilog/db/clkdiv.sld_design_entry_dsc.sci
EX1/clkdivverilog/db/clkdiv.syn_hier_info
EX1/clkdivverilog/db/clkdiv.tan.qmsg
EX1/clkdivverilog/db/clkdiv.tis_db_list.ddb
EX1/clkdivverilog/db/clkdiv_global_asgn_op.abo
EX1/clkdivverilog/db/prev_cmp_clkdiv.asm.qmsg
EX1/clkdivverilog/db/prev_cmp_clkdiv.fit.qmsg
EX1/clkdivverilog/db/prev_cmp_clkdiv.map.qmsg
EX1/clkdivverilog/db/prev_cmp_clkdiv.qmsg
EX1/clkdivverilog/db/prev_cmp_clkdiv.tan.qmsg
EX1/clkdivverilog/.sopc_builder/install.ptf
EX1/clkdivverilog/incremental_db/compiled_partitions
EX1/clkdivverilog/incremental_db
EX1/clkdivverilog/db
EX1/clkdivverilog/.sopc_builder
EX1/clkdivverilog
EX1

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