文件名称:FPGAandRS232-485VerilogSourcecode
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- 上传时间:2012-11-16
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FPGA串行通信口RS232-485构建,RS232和485有选择控制,源程序基于QuartusII6.0用Verilog语言撰写。-FPGA serial communication port RS232-485 build, RS232 and 485 to selectively control, source-based QuartusII6.0 written in Verilog language.
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db/add_sub_3rh.tdf
db/add_sub_4rh.tdf
db/add_sub_5rh.tdf
db/add_sub_8rh.tdf
db/altsyncram_fji2.tdf
db/altsyncram_hji2.tdf
db/cmpr_5mh.tdf
db/cntr_3jf.tdf
db/cntr_4ag.tdf
db/cntr_7he.tdf
db/cntr_8he.tdf
db/cntr_f7f.tdf
db/cntr_pdh.tdf
db/decode_ogi.tdf
db/mux_8ec.tdf
db/mux_jcc.tdf
db/mux_qfc.tdf
db/rs.db_info
db/rs.eco.cdb
db/rs.sim.vwf
db/rs.sld_design_entry.sci
db/wed.wsf
db/wed.zsf
div_clk.bsf
div_clk.v
rs.bdf
rs.bsf
rs.cdf
rs.qpf
rs.vwf
rs.asm.rpt
rs.done
rs.dpf
rs.fit.rpt
rs.fit.smsg
rs.fit.summary
rs.flow.rpt
rs.map.rpt
rs.map.smsg
rs.map.summary
rs.pin
rs.pof
rs.qsf
rs.qws
rs.sim.rpt
rs.sof
rs.tan.rpt
rs.tan.summary
rs_assignment_defaults.qdf
rxd.bsf
rxd.v
stp1.stp
txd.bsf
txd.v
Waveform1.vwf
db
db/add_sub_4rh.tdf
db/add_sub_5rh.tdf
db/add_sub_8rh.tdf
db/altsyncram_fji2.tdf
db/altsyncram_hji2.tdf
db/cmpr_5mh.tdf
db/cntr_3jf.tdf
db/cntr_4ag.tdf
db/cntr_7he.tdf
db/cntr_8he.tdf
db/cntr_f7f.tdf
db/cntr_pdh.tdf
db/decode_ogi.tdf
db/mux_8ec.tdf
db/mux_jcc.tdf
db/mux_qfc.tdf
db/rs.db_info
db/rs.eco.cdb
db/rs.sim.vwf
db/rs.sld_design_entry.sci
db/wed.wsf
db/wed.zsf
div_clk.bsf
div_clk.v
rs.bdf
rs.bsf
rs.cdf
rs.qpf
rs.vwf
rs.asm.rpt
rs.done
rs.dpf
rs.fit.rpt
rs.fit.smsg
rs.fit.summary
rs.flow.rpt
rs.map.rpt
rs.map.smsg
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rs.pin
rs.pof
rs.qsf
rs.qws
rs.sim.rpt
rs.sof
rs.tan.rpt
rs.tan.summary
rs_assignment_defaults.qdf
rxd.bsf
rxd.v
stp1.stp
txd.bsf
txd.v
Waveform1.vwf
db
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