文件名称:velocity_Verilog
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- 上传时间：2012-11-16
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速度表（velocity）要求：1．显示汽车Km/h数；2．车轮每转一圈，有一传感脉冲；每个脉冲代表1m的距离；3．采样周期设为10s；
4．要求显示到小数点后边两位；5．用数码管显示；6. 最高时速小于300Km/h。（约为83.3m/s）
-use verilog to realize velocity
4．要求显示到小数点后边两位；5．用数码管显示；6. 最高时速小于300Km/h。（约为83.3m/s）
-use verilog to realize velocity
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下载文件列表
汽车时速表的Verilog实现
汽车时速表的Verilog实现/velocity/velocity.txt
汽车时速表的Verilog实现/velocity/velocity.v
汽车时速表的Verilog实现/velocity/velocity.v.bak
汽车时速表的Verilog实现/velocity/velocity_prj.cr.mti
汽车时速表的Verilog实现/velocity/velocity_prj.mpf
汽车时速表的Verilog实现/velocity/velocity_testbench.txt
汽车时速表的Verilog实现/velocity/velocity_testbench.v
汽车时速表的Verilog实现/velocity/velocity_testbench.v.bak
汽车时速表的Verilog实现/velocity/vsim.wlf
汽车时速表的Verilog实现/velocity/work/velocity/verilog.asm
汽车时速表的Verilog实现/velocity/work/velocity/verilog.rw
汽车时速表的Verilog实现/velocity/work/velocity/_primary.dat
汽车时速表的Verilog实现/velocity/work/velocity/_primary.dbs
汽车时速表的Verilog实现/velocity/work/velocity/_primary.vhd
汽车时速表的Verilog实现/velocity/work/velocity_testbench/verilog.asm
汽车时速表的Verilog实现/velocity/work/velocity_testbench/verilog.rw
汽车时速表的Verilog实现/velocity/work/velocity_testbench/_primary.dat
汽车时速表的Verilog实现/velocity/work/velocity_testbench/_primary.dbs
汽车时速表的Verilog实现/velocity/work/velocity_testbench/_primary.vhd
汽车时速表的Verilog实现/velocity/work/_info
汽车时速表的Verilog实现/velocity/work/_vmake
汽车时速表的Verilog实现/velocity/速度表题目要求.doc
汽车时速表的Verilog实现/velocity/work/velocity
汽车时速表的Verilog实现/velocity/work/velocity_testbench
汽车时速表的Verilog实现/velocity/work/_temp
汽车时速表的Verilog实现/velocity/work
汽车时速表的Verilog实现/velocity
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