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文件名称:S6_VGA_change

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    3.11mb
  • 已下载：
    0次
  • 提 供 者：
    成***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

1。源文件保存在src目录，QII的工程文件保存在Proj目录；

2。程序可以在VGA显示器上以800x600分辨率显示方波示例和字母示例

3。具体设计参考代码。

-1. Save the source file in the src directory, QII project files in the directory Proj　2. Program can display at VGA display with 800x600 resolution and square-wave sample letters Example 3. Specific design reference code.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

S6_VGA_change/
S6_VGA_change/Doc/
S6_VGA_change/Doc/程序说明.txt
S6_VGA_change/Proj/
S6_VGA_change/Proj/cmp_state.ini
S6_VGA_change/Proj/ColorBar.asm.rpt
S6_VGA_change/Proj/ColorBar.cdf
S6_VGA_change/Proj/ColorBar.done
S6_VGA_change/Proj/ColorBar.eda.rpt
S6_VGA_change/Proj/ColorBar.fit.eqn
S6_VGA_change/Proj/ColorBar.fit.rpt
S6_VGA_change/Proj/ColorBar.fit.smsg
S6_VGA_change/Proj/ColorBar.fit.summary
S6_VGA_change/Proj/ColorBar.flow.rpt
S6_VGA_change/Proj/ColorBar.jdi
S6_VGA_change/Proj/ColorBar.map.eqn
S6_VGA_change/Proj/ColorBar.map.rpt
S6_VGA_change/Proj/ColorBar.map.summary
S6_VGA_change/Proj/ColorBar.mif
S6_VGA_change/Proj/ColorBar.pin
S6_VGA_change/Proj/ColorBar.pof
S6_VGA_change/Proj/ColorBar.qpf
S6_VGA_change/Proj/ColorBar.qsf
S6_VGA_change/Proj/ColorBar.qws
S6_VGA_change/Proj/ColorBar.sof
S6_VGA_change/Proj/ColorBar.tan.rpt
S6_VGA_change/Proj/ColorBar.tan.summary
S6_VGA_change/Proj/ColorBar_assignment_defaults.qdf
S6_VGA_change/Proj/db/
S6_VGA_change/Proj/db/altsyncram_qso3.tdf
S6_VGA_change/Proj/db/cntr_72i.tdf
S6_VGA_change/Proj/db/cntr_cmi.tdf
S6_VGA_change/Proj/db/cntr_o3i.tdf
S6_VGA_change/Proj/db/cntr_qsi.tdf
S6_VGA_change/Proj/db/ColorBar.db_info
S6_VGA_change/Proj/db/ColorBar.eco.cdb
S6_VGA_change/Proj/db/ColorBar.sld_design_entry.sci
S6_VGA_change/Proj/db/decode_9jf.tdf
S6_VGA_change/Proj/db/decode_ogi.tdf
S6_VGA_change/Proj/db/mux_ngc.tdf
S6_VGA_change/Proj/db/prev_cmp_ColorBar.map.qmsg
S6_VGA_change/Proj/db/prev_cmp_ColorBar.qmsg
S6_VGA_change/Proj/rom.bsf
S6_VGA_change/Proj/rom.v
S6_VGA_change/Proj/rom_8.bsf
S6_VGA_change/Proj/rom_8.v
S6_VGA_change/Proj/rom_8_bb.v
S6_VGA_change/Proj/rom_bb.v
S6_VGA_change/Proj/simulation/
S6_VGA_change/Proj/simulation/modelsim/
S6_VGA_change/Proj/simulation/modelsim/ColorBar.vo
S6_VGA_change/Proj/simulation/modelsim/ColorBar_modelsim.xrf
S6_VGA_change/Proj/simulation/modelsim/ColorBar_v.sdo
S6_VGA_change/Proj/simulation/modelsim/cyclone_atoms.v
S6_VGA_change/Proj/simulation/modelsim/vga_test.cr.mti
S6_VGA_change/Proj/simulation/modelsim/vga_test.mpf
S6_VGA_change/Proj/simulation/modelsim/vga_test.v
S6_VGA_change/Proj/simulation/modelsim/vga_vl.v
S6_VGA_change/Proj/simulation/modelsim/vsim.wlf
S6_VGA_change/Proj/simulation/modelsim/wave.do
S6_VGA_change/Proj/simulation/modelsim/work/
S6_VGA_change/Proj/simulation/modelsim/work/@c@y@c@l@o@n@e_@p@r@i@m_@d@f@f@e/
S6_VGA_change/Proj/simulation/modelsim/work/@c@y@c@l@o@n@e_@p@r@i@m_@d@f@f@e/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/@c@y@c@l@o@n@e_@p@r@i@m_@d@f@f@e/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/@c@y@c@l@o@n@e_@p@r@i@m_@d@f@f@e/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/@color@bar/
S6_VGA_change/Proj/simulation/modelsim/work/@color@bar/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/@color@bar/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/@color@bar/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and1/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and16/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and16/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and16/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and16/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and1/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and1/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_and1/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asmiblock/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asmiblock/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asmiblock/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asmiblock/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_io/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_io/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_io/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_io/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_lcell/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_lcell/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_lcell/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_asynch_lcell/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b17mux21/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b17mux21/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b17mux21/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b17mux21/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b5mux21/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b5mux21/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b5mux21/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_b5mux21/_primary.vhd
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_bmux21/
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_bmux21/verilog.asm
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_bmux21/_primary.dat
S6_VGA_change/Proj/simulation/modelsim/work/cyclone_bmux21/_prima

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