文件名称:Sim_counter
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所属分类:
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- 上传时间:2012-11-16
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文件大小:5.07kb
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VHDL 在modelsim上进行前仿真,综合仿真以及时序仿真需要文件(以一个简单计数器为例)-On the front in modelsim VHDL simulation, synthesis and timing simulation requires a simulation file (a simple counter example)
(系统自动生成,下载前可以参看下载内容)
下载文件列表
Sim_counter.vhd
Sim_counter.vho
Sim_counter_vhd.sdo
Sim_counter_vhd_tst.vht
Sim_counter.vho
Sim_counter_vhd.sdo
Sim_counter_vhd_tst.vht
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