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文件名称:61EDA_H582

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    8.82mb
  • 已下载：
    0次
  • 提 供 者：
    ha***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该文件主要是关于采用ERIOLOG设计可编程逻辑器件的文档-This paper is about verilog HDL.
(系统自动生成,下载前可以参看下载内容)

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用FPGA做的一个32路AD程序(用VERLlog写的)/DFCPU/.metadata/.lock
用FPGA做的一个32路AD程序(用VERLlog写的)/DFCPU/.metadata/.log
用FPGA做的一个32路AD程序(用VERLlog写的)/DFCPU/.metadata/.plugins/com.altera.nj.ui/dialog_settings.xml
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