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文件名称:MODELSYS

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    10.37mb
  • 已下载：
    2次
  • 提 供 者：
    权***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog编写的运动自适应去隔行算法 表扩边缘检测 sad最小值编写-Verilog written with motion-adaptive deinterlacing algorithm detects the edge of the table to expand the minimum write sad
相关搜索： motion adaptive verilog SAD veilog

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MODELSYS/50帧处理后的数据导出/datao_yuyv_50f.txt
MODELSYS/50帧处理后的数据导出/datao_y_50f.txt
MODELSYS/FLS数据到SRAM.bmp
MODELSYS/NEWSYS/atera/_info
MODELSYS/NEWSYS/datao_vu_1flog.log
MODELSYS/NEWSYS/datao_vu_50f.txt
MODELSYS/NEWSYS/datao_yuyv_1flog.log
MODELSYS/NEWSYS/datao_yuyv_50f.txt
MODELSYS/NEWSYS/datao_y_1flog.log
MODELSYS/NEWSYS/datao_y_50f.txt
MODELSYS/NEWSYS/deinterlace/average.v
MODELSYS/NEWSYS/deinterlace/average.v.bak
MODELSYS/NEWSYS/deinterlace/deinterlace.v
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MODELSYS/NEWSYS/deinterlace/diffmin_new.v.bak
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MODELSYS/NEWSYS/deinterlace/minl.v
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MODELSYS/NEWSYS/flash/am29lv256m.v.bak
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MODELSYS/NEWSYS/flash/flash_package.v.bak
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MODELSYS/NEWSYS/framebuf.v.bak
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MODELSYS/NEWSYS/vga_dis/VGA_test1/vgainterface/db/prev_cmp_vga

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相关评论

vlink_macro@163.com (未下载) 发表于 09-06 09:34

我下载了，跑起来之后图像会往上翻，请问是不是这个算法本身的原因啊。我通过仿真实在是找不到问题了

vlink_macro@163.com (未下载) 发表于 07-22 10:45

具体用的那种算法呢，有没有相关资料。谢谢！ 光code看得太费劲了。 vlink_macro@163.com

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