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文件名称:USB_IP-CORE-design

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    196.63kb
  • 已下载：
    1次
  • 提 供 者：
    董***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

USB2.0的IP核，需要添加额外的PHY模块，使用Verilog语言编写-USB2.0 IP core, you need to add additional PHY module, using the Verilog language
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog/usbf_crc16.v
verilog/usbf_crc5.v
verilog/usbf_defines.v
verilog/usbf_ep_rf.v
verilog/usbf_ep_rf_dummy.v
verilog/usbf_idma.v
verilog/usbf_mem_arb.v
verilog/usbf_pa.v
verilog/usbf_pd.v
verilog/usbf_pe.v
verilog/usbf_pl.v
verilog/usbf_rf.v
verilog/usbf_top.v
verilog/usbf_utmi_if.v
verilog/usbf_utmi_ls.v
verilog/usbf_wb.v
usb_doc.pdf
verilog

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