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文件名称:5B6B-codec

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.47kb
  • 已下载：
    2次
  • 提 供 者：
    林****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog hdl实现5B6B编译码（光纤通信线路码型），包含了时钟发生器模块 ，信号源模块 ，编码模块 ，译码模块， 和检错模块，并通过modesim仿真验证。-verilog hdl achieve 5B6B encoding and decoding (code-based fiber-optic communication lines), contains a clock generator module, signal source modules, code modules, decoding module, and error detection module, and through modesim simulation.
相关搜索： ERROR DETECTION verilog 5B6B verilog 通信 verilog code for signal generator

(系统自动生成,下载前可以参看下载内容)

下载文件列表

5B6B编译码/check_error.v
5B6B编译码/clk_generate.v
5B6B编译码/coder.v
5B6B编译码/encoder.v
5B6B编译码/fiveB_sixB_encoder.v
5B6B编译码/signal_source.v
5B6B编译码/test.v
5B6B编译码

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