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文件名称:generic_fifo_yh

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    37.31kb
  • 已下载：
    0次
  • 提 供 者：
    杨***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

Generic, multi-purpose FIFOs. Available as single clock and dual clock version, binary, lfsr, and gray encoded (dual clock only). All are parameterizable and use generic_memories for memory. These FIFOs are fully portable from FPGAs to ASICS.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

generic_fifo_yh/tags/start/doc/README.txt
generic_fifo_yh/tags/start/sim/rtl_sim/run/waves/waves.do
generic_fifo_yh/tags/start/sim/rtl_sim/bin/Makefile
generic_fifo_yh/tags/start/bench/verilog/test_bench_top.v
generic_fifo_yh/tags/start/rtl/verilog/timescale.v
generic_fifo_yh/tags/start/rtl/verilog/generic_fifo_dc.v
generic_fifo_yh/tags/start/rtl/verilog/generic_fifo_sc_b.v
generic_fifo_yh/tags/start/rtl/verilog/generic_fifo_sc_a.v
generic_fifo_yh/trunk/doc/README.txt
generic_fifo_yh/trunk/sim/rtl_sim/run/waves/waves.do
generic_fifo_yh/trunk/sim/rtl_sim/bin/Makefile
generic_fifo_yh/trunk/bench/verilog/test_bench_top.v
generic_fifo_yh/trunk/rtl/verilog/timescale.v
generic_fifo_yh/trunk/rtl/verilog/lfsr.v
generic_fifo_yh/trunk/rtl/verilog/generic_fifo_dc.v
generic_fifo_yh/trunk/rtl/verilog/generic_fifo_lfsr.v
generic_fifo_yh/trunk/rtl/verilog/generic_fifo_sc_b.v
generic_fifo_yh/trunk/rtl/verilog/generic_fifo_sc_a.v
generic_fifo_yh/trunk/rtl/verilog/generic_fifo_dc_gray.v
generic_fifo_yh/tags/start/sim/rtl_sim/run/waves
generic_fifo_yh/tags/start/sim/rtl_sim/run
generic_fifo_yh/tags/start/sim/rtl_sim/bin
generic_fifo_yh/trunk/sim/rtl_sim/run/waves
generic_fifo_yh/tags/start/sim/rtl_sim
generic_fifo_yh/tags/start/bench/verilog
generic_fifo_yh/tags/start/rtl/verilog
generic_fifo_yh/trunk/sim/rtl_sim/run
generic_fifo_yh/trunk/sim/rtl_sim/bin
generic_fifo_yh/tags/start/doc
generic_fifo_yh/tags/start/sim
generic_fifo_yh/tags/start/bench
generic_fifo_yh/tags/start/rtl
generic_fifo_yh/trunk/sim/rtl_sim
generic_fifo_yh/trunk/bench/verilog
generic_fifo_yh/trunk/rtl/verilog
generic_fifo_yh/tags/start
generic_fifo_yh/trunk/doc
generic_fifo_yh/trunk/sim
generic_fifo_yh/trunk/bench
generic_fifo_yh/trunk/rtl
generic_fifo_yh/tags
generic_fifo_yh/branches
generic_fifo_yh/trunk
generic_fifo_yh/web_uploads
generic_fifo_yh

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