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文件名称:Computer-Architecture-lab1

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    65.6kb
  • 已下载：
    0次
  • 提 供 者：
    聪***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

计算机组成实验作业1，fpga开发板，verilog语言编写-Composition of experimental computer operating 1, fpga development board, verilog language
(系统自动生成,下载前可以参看下载内容)

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09级计组实验_B班_31组_5090309744_谢聪_实验1代码/lab1.gise
09级计组实验_B班_31组_5090309744_谢聪_实验1代码/lab1.ise
09级计组实验_B班_31组_5090309744_谢聪_实验1代码/lab1.xise
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