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文件名称:32bit-RISC-CPU-IP

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    32.53kb
  • 已下载：
    1次
  • 提 供 者：
    张****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用Verilog语言实现的RISC精简指令集CPU IP核，该CPU具有32位数据宽度，5级流水线结构和指令预判和中断处理功能，适合Verilog语言深入学习者参考。-Using the Verilog language implementation of RISC Reduced Instruction Set CPU IP cores, the CPU has a 32-bit data width, 5-stage pipeline structure and instruction pre-judgment and interrupt handling functions for Verilog language learners in depth reference.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

32bit RISC CPU IP/potato_verilog/alu.v
32bit RISC CPU IP/potato_verilog/cntrl_rf.v
32bit RISC CPU IP/potato_verilog/cpu.v
32bit RISC CPU IP/potato_verilog/decode.v
32bit RISC CPU IP/potato_verilog/forward.v
32bit RISC CPU IP/potato_verilog/interrupt.v
32bit RISC CPU IP/potato_verilog/mpu.v
32bit RISC CPU IP/potato_verilog/pc_gen.v
32bit RISC CPU IP/potato_verilog/ram.v
32bit RISC CPU IP/potato_verilog/regfile.v
32bit RISC CPU IP/potato_verilog/reg_ex.v
32bit RISC CPU IP/potato_verilog/reg_id.v
32bit RISC CPU IP/potato_verilog/reg_if.v
32bit RISC CPU IP/potato_verilog/reg_mem.v
32bit RISC CPU IP/potato_verilog/rom.v
32bit RISC CPU IP/potato_verilog/write_back.v
32bit RISC CPU IP/约束文件.doc
32bit RISC CPU IP/potato_verilog
32bit RISC CPU IP

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