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文件名称:vhdl-eg

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    3.94mb
  • 已下载:
    0次
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  • 下载说明:
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如迅雷强制弹出,可右键点击选“另存为”。
失败请重下,重下不扣分。

介绍说明--下载内容来自于网络,使用问题请自行百度

It is a nor gate.That is extensively used in digital circuits. it is a complement of OR gate.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

vhdl eg/0~alu.vhd
vhdl eg/0~index.html
vhdl eg/active0.jpg
vhdl eg/active1.jpg
vhdl eg/active2.jpg
vhdl eg/active3.jpg
vhdl eg/active4.jpg
vhdl eg/active5.jpg
vhdl eg/active6.jpg
vhdl eg/active8.jpg
vhdl eg/active9.jpg
vhdl eg/Active_Tutorial.html
vhdl eg/adder.jpg
vhdl eg/adder.vhd
vhdl eg/adder_sch.jpg
vhdl eg/adder_sim.jpg
vhdl eg/ALU.jpg
vhdl eg/ALU.vhd
vhdl eg/alu_sch.jpg
vhdl eg/alu_sim.jpg
vhdl eg/and.jpg
vhdl eg/AND_gate.vhd
vhdl eg/area.jpg
vhdl eg/Area_Timing.jpg
vhdl eg/area_timing_table.jpg
vhdl eg/backontop.gif
vhdl eg/bg.jpg
vhdl eg/bigmux.vhd
vhdl eg/book1.gif
vhdl eg/bridge.jpg
vhdl eg/bridge.vhd
vhdl eg/bridge2.jpg
vhdl eg/bridge2.vhd
vhdl eg/bridge2_gate.vhd
vhdl eg/bridge2_sch.jpg
vhdl eg/bridge_gate.vhd
vhdl eg/bridge_sch.jpg
vhdl eg/bridge_sim.jpg
vhdl eg/coffeecup.gif
vhdl eg/combckt_sch.jpg
vhdl eg/comb_ckt.jpg
vhdl eg/comb_ckt.vhd
vhdl eg/comb_sim.jpg
vhdl eg/comparator.jpg
vhdl eg/comparator.vhd
vhdl eg/comparator_sch.jpg
vhdl eg/comparator_sim.jpg
vhdl eg/controller.vhd
vhdl eg/counter.jpg
vhdl eg/counter.vhd
vhdl eg/counter_gate.vhd
vhdl eg/counter_sch.jpg
vhdl eg/counter_sim.jpg
vhdl eg/counter_syn.scr
vhdl eg/cpublock.jpg
vhdl eg/cpugatesim.scr
vhdl eg/cpuhierarchy.jpg
vhdl eg/cpusim.scr
vhdl eg/cpusim1.jpg
vhdl eg/cpusim2.jpg
vhdl eg/cpusyn.scr
vhdl eg/ctrl_unit.vhd
vhdl eg/datapath.vhd
vhdl eg/decoder.jpg
vhdl eg/decoder.vhd
vhdl eg/decoder_sch.jpg
vhdl eg/decoder_sim.jpg
vhdl eg/dff.jpg
vhdl eg/dff.vhd
vhdl eg/dff_gate.vhd
vhdl eg/dff_sim.jpg
vhdl eg/driver.jpg
vhdl eg/DRIVER.vhd
vhdl eg/FIR.vhd
vhdl eg/fir1.jpg
vhdl eg/fir2.jpg
vhdl eg/fir_gate.vhd
vhdl eg/fir_sch.jpg
vhdl eg/fir_sim.jpg
vhdl eg/FIR_syn.scr
vhdl eg/Flashball.gif
vhdl eg/fsm.vhd
vhdl eg/fsm_gate.vhd
vhdl eg/fsm_sch.jpg
vhdl eg/fsm_sim.jpg
vhdl eg/gcd.jpg
vhdl eg/GCD.vhd
vhdl eg/gcd1.vhd
vhdl eg/gcd2.jpg
vhdl eg/gcd2.vhd
vhdl eg/gcd2_gate.vhd
vhdl eg/gcd2_sch.jpg
vhdl eg/gcd2_sim.jpg
vhdl eg/gcd_gate.vhd
vhdl eg/gcd_sch.jpg
vhdl eg/gcd_sim.jpg
vhdl eg/index (2).html
vhdl eg/index.html
vhdl eg/inverter.jpg
vhdl eg/IR.vhd
vhdl eg/ISA.jpg
vhdl eg/ISA.vhd
vhdl eg/ISA_gate.vhd
vhdl eg/ISA_sch.jpg
vhdl eg/ISA_sim.jpg
vhdl eg/jkff.jpg
vhdl eg/jkff.vhd
vhdl eg/jkff_gate.vhd
vhdl eg/jkff_sim.jpg
vhdl eg/latch.jpg
vhdl eg/latch.vhd
vhdl eg/latch_gate.vhd
vhdl eg/latch_sim.jpg
vhdl eg/memory.vhd
vhdl eg/microprocessor.vhd
vhdl eg/multiplier.jpg
vhdl eg/multiplier.vhd
vhdl eg/multiplier_sch.jpg
vhdl eg/multiplier_sim.jpg
vhdl eg/mux.jpg
vhdl eg/mux.vhd
vhdl eg/mux_sch.jpg
vhdl eg/mux_sim.jpg
vhdl eg/nand.jpg
vhdl eg/NAND_gate.vhd
vhdl eg/nor.jpg
vhdl eg/NOR_gate.rar
vhdl eg/NOR_gate.vhd
vhdl eg/obuf.vhd
vhdl eg/or.jpg
vhdl eg/OR_gate.vhd
vhdl eg/PC.vhd
vhdl eg/pointer.gif
vhdl eg/Power.jpg
vhdl eg/R1_syn.gif
vhdl eg/R2_syn.gif
vhdl eg/R3_syn.gif
vhdl eg/RAM.jpg
vhdl eg/RAM.vhd
vhdl eg/RAM_gate.vhd
vhdl eg/RAM_sch.jpg
vhdl eg/RAM_sim.jpg
vhdl eg/Recei_model.vhd
vhdl eg/register.jpg
vhdl eg/register.vhd
vhdl eg/register_gate.vhd
vhdl eg/register_sch.jpg
vhdl eg/register_sim.jpg
vhdl eg/reg_file.vhd
vhdl eg/ROM.jpg
vhdl eg/ROM.vhd
vhdl eg/ROM_gate.vhd
vhdl eg/ROM_sch.jpg
vhdl eg/ROM_sim.jpg
vhdl eg/shifter.jpg
vhdl eg/shifter.vhd
vhdl eg/shifter_gate.vhd
vhdl eg/shifter_sch.jpg
vhdl eg/shifter_sim.jpg
vhdl eg/sig_var.jpg
vhdl eg/sig_var.vhd
vhdl eg/smallmux.vhd
vhdl eg/syn_alu.inc
vhdl eg/syn_bigmux.inc
vhdl eg/syn_controller.inc
vhdl eg/syn_ctrl_unit.inc
vhdl eg/syn_datapath.inc
vhdl eg/syn_IR.inc
vhdl eg/syn_memory.inc
vhdl eg/syn_obuf.inc
vhdl eg/syn_PC.inc
vhdl eg/syn_reg_file.inc
vhdl eg/syn_smallmux.inc
vhdl eg/T1_syn.gif
vhdl eg/T2_syn.gif
vhdl eg/T3_syn.gif
vhdl eg/TB1_receiver.vhd
vhdl eg/TB1_transmitter.vhd
vhdl eg/TB2_receiver.vhd
vhdl eg/TB2_transmitter.vhd
vhdl eg/TB3_receiver.vhd
vhdl eg/TB3_transmitter.vhd
vhdl eg/tb_adder.vhd
vhdl eg/tb_ALU.vhd
vhdl eg/tb_bridge.vhd
vhdl eg/tb_bridge2.vhd
vhdl eg/tb_ckt.vhd
vhdl eg/tb_comparator.vhd
vhdl eg/tb_counter.vhd
vhdl eg/tb_decoder.vhd
vhdl eg/tb_dff.vhd
vhdl eg/tb_FIR.vhd
vhdl eg/tb_fsm.vhd
vhdl eg/tb_gcd.vhd
vhdl eg/tb_gcd2.vhd
vhdl eg/tb_ISA.vhd
vhdl eg/tb_jkff.vhd
vhdl eg/tb_latch.vhd
vhdl eg/TB_mp.vhd
vhdl eg/tb_multiplier.vhd
vhdl eg/tb_mux.vhd
vhdl eg/TB_RAM.vhd
vhdl eg/tb_register.vhd
vhdl eg/TB_ROM.vhd
vhdl eg/tb_shifter.vhd
vhdl eg/tb_tridriver.vhd
vhdl eg/TB_UART.vhd
vhdl eg/timing.jpg
vhdl eg/trans_gate.vhd
vhdl eg/Trans_model.vhd
vhdl eg/tridriver.jpg
vhdl eg/tridriver_sch.jpg
vhdl eg/tridriver_sim.jpg
vhdl eg/tri_driver.vhd
vhdl eg/UART6402.pdf
vhdl eg/UART_6402.vhd
vhdl eg/UART_gate.vhd
vhdl eg/UART_sim.gif
vhdl eg/VHDL.jpg
vhdl eg/VHDL_Page.html
vhdl eg/xnor.jpg
vhdl eg/XNOR_gate.vhd
vhdl eg/xor.jpg
vhdl eg/XOR_gate.vhd
vhdl eg/Y_chart.jpg
vhdl eg/esd.cs.ucr.edu/labs/tutorial
vhdl eg/esd.cs.ucr.edu/labs
vhdl eg/esd.cs.ucr.edu
vhdl eg

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