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文件名称:Four-adder-of-subtracter

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    553.7kb
  • 已下载：
    0次
  • 提 供 者：
    东*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

在max+plus II 的环境下设计4位全加器数字电路

使用vhdl语言，进行设计数字电路的RTL级电路

-Four full adder digital circuit design environment, max+ plus II

RTL-level circuit, digital circuit design using vhdl language
(系统自动生成,下载前可以参看下载内容)

下载文件列表

四位全加全减器设计.doc

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