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文件名称:DE2_115_TV

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    865.25kb
  • 已下载：
    0次
  • 提 供 者：
    杨****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

DE2-115开发板TV摄像头成像程序，源码亲测可用，可加入边缘算法成像，实时显示轮廓，速度流畅-The DE2-115 development board TV camera imaging procedures, the pro-test in the source can be added to the edge algorithms imaging, real-time display contours, fast-paced
(系统自动生成,下载前可以参看下载内容)

下载文件列表

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DE2_115_TV/altera.components/.settings/
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DE2_115_TV/DE2_115_TV.qpf
DE2_115_TV/DE2_115_TV.qsf
DE2_115_TV/DE2_115_TV.sof
DE2_115_TV/DE2_115_TV.v
DE2_115_TV/DE2_115_TV_assignment_defaults.qdf
DE2_115_TV/demo_batch/
DE2_115_TV/demo_batch/de2_115_tv.bat
DE2_115_TV/demo_batch/DE2_115_TV.sof
DE2_115_TV/DIV.bsf
DE2_115_TV/DIV.qip
DE2_115_TV/DIV.v
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DE2_115_TV/I2C_AV_Config.v
DE2_115_TV/I2C_Controller.v
DE2_115_TV/ITU_656_Decoder.v
DE2_115_TV/Line_Buffer.bsf
DE2_115_TV/Line_Buffer.qip
DE2_115_TV/Line_Buffer.v
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DE2_115_TV/MAC_3.v
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DE2_115_TV/PLL.v
DE2_115_TV/PLLJ_PLLSPE_INFO.txt
DE2_115_TV/Reset_Delay.v
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DE2_115_TV/Sdram_Control_4Port/command.v
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DE2_115_TV/Sdram_Control_4Port/Sdram_PLL.bsf
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DE2_115_TV/SEG7_LUT_8.v
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DE2_115_TV/TP_RAM.v
DE2_115_TV/VGA_Ctrl.v
DE2_115_TV/YCbCr2RGB.v
DE2_115_TV/YUV422_to_444.v

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