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文件名称:sdram

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    18.01kb
  • 已下载：
    0次
  • 提 供 者：
    蔡****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

在ISE环境中，利用verilog语言编写的SDRAM的控制，已经通过功能仿真，其中PLL部分并没有加入，使用时可以自行加入PLL模块。-Verilog language in the ISE environment, the use of SDRAM control, through functional simulation, which the PLL part and did not join, can join the PLL blocks.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

sdram/
sdram/command.v
sdram/command.v.bak
sdram/control_interface.v
sdram/control_interface.v.bak
sdram/dcm_test.v
sdram/params.v.bak
sdram/sdr_data_path.v
sdram/sdr_data_path.v.bak
sdram/sdr_sdram.v
sdram/sdr_sdram.v.bak
sdram/tb.v
sdram/tb.v.bak
sdram/tbcmd.v
sdram/tbcmd.v.bak
sdram/tbcontrol.v
sdram/tbdata.v
sdram/tbdata.v.bak

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