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文件名称:div16_tff

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    140.94kb
  • 已下载：
    0次
  • 提 供 者：
    longd******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该工程设计了一个16分频的分频器，电路采用T触发器，已通过仿真。-The engineering design of a 16 frequency divider circuit using T flip-flop, through simulation.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

div16_tff/db/div16_tff.(0).cnf.cdb
div16_tff/db/div16_tff.(0).cnf.hdb
div16_tff/db/div16_tff.asm.qmsg
div16_tff/db/div16_tff.cbx.xml
div16_tff/db/div16_tff.cmp.bpm
div16_tff/db/div16_tff.cmp.cdb
div16_tff/db/div16_tff.cmp.ecobp
div16_tff/db/div16_tff.cmp.hdb
div16_tff/db/div16_tff.cmp.logdb
div16_tff/db/div16_tff.cmp.rdb
div16_tff/db/div16_tff.cmp.tdb
div16_tff/db/div16_tff.cmp0.ddb
div16_tff/db/div16_tff.cmp_bb.cdb
div16_tff/db/div16_tff.cmp_bb.hdb
div16_tff/db/div16_tff.cmp_bb.logdb
div16_tff/db/div16_tff.cmp_bb.rcf
div16_tff/db/div16_tff.dbp
div16_tff/db/div16_tff.db_info
div16_tff/db/div16_tff.eco.cdb
div16_tff/db/div16_tff.eds_overflow
div16_tff/db/div16_tff.fit.qmsg
div16_tff/db/div16_tff.fnsim.cdb
div16_tff/db/div16_tff.fnsim.hdb
div16_tff/db/div16_tff.fnsim.qmsg
div16_tff/db/div16_tff.hier_info
div16_tff/db/div16_tff.hif
div16_tff/db/div16_tff.map.bpm
div16_tff/db/div16_tff.map.cdb
div16_tff/db/div16_tff.map.ecobp
div16_tff/db/div16_tff.map.hdb
div16_tff/db/div16_tff.map.logdb
div16_tff/db/div16_tff.map.qmsg
div16_tff/db/div16_tff.map_bb.cdb
div16_tff/db/div16_tff.map_bb.hdb
div16_tff/db/div16_tff.map_bb.logdb
div16_tff/db/div16_tff.merge.qmsg
div16_tff/db/div16_tff.pre_map.cdb
div16_tff/db/div16_tff.pre_map.hdb
div16_tff/db/div16_tff.psp
div16_tff/db/div16_tff.pss
div16_tff/db/div16_tff.rtlv.hdb
div16_tff/db/div16_tff.rtlv_sg.cdb
div16_tff/db/div16_tff.rtlv_sg_swap.cdb
div16_tff/db/div16_tff.sgdiff.cdb
div16_tff/db/div16_tff.sgdiff.hdb
div16_tff/db/div16_tff.signalprobe.cdb
div16_tff/db/div16_tff.sim.cvwf
div16_tff/db/div16_tff.sim.hdb
div16_tff/db/div16_tff.sim.qmsg
div16_tff/db/div16_tff.sim.rdb
div16_tff/db/div16_tff.sld_design_entry.sci
div16_tff/db/div16_tff.sld_design_entry_dsc.sci
div16_tff/db/div16_tff.syn_hier_info
div16_tff/db/div16_tff.tan.qmsg
div16_tff/db/wed.wsf
div16_tff/div16_tff.asm.rpt
div16_tff/div16_tff.bdf
div16_tff/div16_tff.done
div16_tff/div16_tff.fit.rpt
div16_tff/div16_tff.fit.smsg
div16_tff/div16_tff.fit.summary
div16_tff/div16_tff.flow.rpt
div16_tff/div16_tff.map.rpt
div16_tff/div16_tff.map.summary
div16_tff/div16_tff.merge.rpt
div16_tff/div16_tff.pin
div16_tff/div16_tff.pof
div16_tff/div16_tff.qpf
div16_tff/div16_tff.qsf
div16_tff/div16_tff.qws
div16_tff/div16_tff.sim.cvwf
div16_tff/div16_tff.sim.rpt
div16_tff/div16_tff.sof
div16_tff/div16_tff.tan.rpt
div16_tff/div16_tff.tan.summary
div16_tff/div16_tff.vwf
div16_tff/db
div16_tff

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