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文件名称:AMSD_in_GUI.tar

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.61mb
  • 已下载：
    1次
  • 提 供 者：
    ming*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

锁相环（pll）AMS仿真实例，平台为cadence+ius。-tutorial for the simulation of mixed signal pll
(系统自动生成,下载前可以参看下载内容)

下载文件列表

AMSD_in_GUI/
AMSD_in_GUI/amsPLL/
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AMSD_in_GUI/amsPLL/prop.xx
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AMSD_in_GUI/amsPLL/PLL_160MHZ/behavioral/master.tag
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AMSD_in_GUI/amsPLL/PLL_CP/veriloga/pc.db
AMSD_in_GUI/amsPLL/PLL_CP/veriloga/PLL_CP_eval_CP_ITEST_25u.vat
AMSD_in_GUI/amsPLL/PLL_CP/veriloga/PLL_CP_down_iv_OUT.vat
AMSD_in_GUI/amsPLL/PLL_CP/veriloga/PLL_CP_DN_incap.vat
AMSD_in_GUI/amsPLL/PLL_CP/v

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