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文件名称:eetop.cn_16bits_multiplier

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    585.91kb
  • 已下载：
    1次
  • 提 供 者：
    lib***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

16位并行乘法器源代码，booth2编码，二进制树拓扑结构-16bits parallel multiplier source code


(系统自动生成,下载前可以参看下载内容)

下载文件列表

Copy of modelsim/adder_32.v
Copy of modelsim/compressor.v
Copy of modelsim/mul_booth2.v
Copy of modelsim/tb.v
Copy of modelsim/乘法器设计报告.doc
Copy of modelsim

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