文件名称:ROM_RTL
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所属分类:
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- 上传时间:2012-11-16
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文件大小:41.45kb
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Verilog Source File
In the Quartus10.0 can be run this source code.
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下载文件列表
ROM_RTL/Verilog/rom_rtl.log
ROM_RTL/Verilog/rom_rtl.script
ROM_RTL/Verilog/.synopsys_dc.setup
ROM_RTL/Verilog/rom_rtl.v
ROM_RTL/Verilog/M1_files/rom_rtl.sxnf
ROM_RTL/Verilog/M1_files/rom_rtl.ncf
ROM_RTL/Verilog/M1_files/command.his
ROM_RTL/Verilog/M1_files/ngdbuild.log
ROM_RTL/Verilog/M1_files/netlist.lst
ROM_RTL/Verilog/M1_files/rom_rtl.ngo
ROM_RTL/Verilog/M1_files/rom_rtl.ngd
ROM_RTL/Verilog/M1_files/rom_rtl.bld
ROM_RTL/Verilog/M1_files/map.mrp
ROM_RTL/Verilog/M1_files/map.ngm
ROM_RTL/Verilog/M1_files/rom_rtl.pcf
ROM_RTL/Verilog/M1_files/map.ncd
ROM_RTL/Verilog/M1_files/map.pcf
ROM_RTL/Verilog/M1_files/rom_rtl.par
ROM_RTL/Verilog/M1_files/rom_rtl.ncd
ROM_RTL/Verilog/M1_files/rom_rtl.dly
ROM_RTL/Verilog/M1_files/rom_rtl.pad
ROM_RTL/Verilog/M1_files/rom_rtl.twr
ROM_RTL/Verilog/M1_files/time_sim.alf
ROM_RTL/Verilog/M1_files/time_sim.nga
ROM_RTL/Verilog/M1_files/time_sim.v
ROM_RTL/Verilog/M1_files/time_sim.sdf
ROM_RTL/Verilog/M1_files/time_sim.tv
ROM_RTL/Verilog/M1_files/time_sim.pin
ROM_RTL/Verilog/M1_files/rom_rtl.bgn
ROM_RTL/Verilog/M1_files/rom_rtl.drc
ROM_RTL/Verilog/M1_files/rom_rtl.bit
ROM_RTL/Verilog/command.log
ROM_RTL/Verilog/rom_rtl.fpga
ROM_RTL/Verilog/rom_rtl.timing
ROM_RTL/Verilog/rom_rtl.sxnf
ROM_RTL/Verilog/rom_rtl.db
ROM_RTL/Verilog/rom_rtl.ncf
ROM_RTL/Verilog/dc2ncf.log
ROM_RTL/Verilog/rom_rtl.dc
ROM_RTL/Verilog/rom_rtl.rar
ROM_RTL/Verilog/M1_files
ROM_RTL/Verilog
ROM_RTL
ROM_RTL/Verilog/rom_rtl.script
ROM_RTL/Verilog/.synopsys_dc.setup
ROM_RTL/Verilog/rom_rtl.v
ROM_RTL/Verilog/M1_files/rom_rtl.sxnf
ROM_RTL/Verilog/M1_files/rom_rtl.ncf
ROM_RTL/Verilog/M1_files/command.his
ROM_RTL/Verilog/M1_files/ngdbuild.log
ROM_RTL/Verilog/M1_files/netlist.lst
ROM_RTL/Verilog/M1_files/rom_rtl.ngo
ROM_RTL/Verilog/M1_files/rom_rtl.ngd
ROM_RTL/Verilog/M1_files/rom_rtl.bld
ROM_RTL/Verilog/M1_files/map.mrp
ROM_RTL/Verilog/M1_files/map.ngm
ROM_RTL/Verilog/M1_files/rom_rtl.pcf
ROM_RTL/Verilog/M1_files/map.ncd
ROM_RTL/Verilog/M1_files/map.pcf
ROM_RTL/Verilog/M1_files/rom_rtl.par
ROM_RTL/Verilog/M1_files/rom_rtl.ncd
ROM_RTL/Verilog/M1_files/rom_rtl.dly
ROM_RTL/Verilog/M1_files/rom_rtl.pad
ROM_RTL/Verilog/M1_files/rom_rtl.twr
ROM_RTL/Verilog/M1_files/time_sim.alf
ROM_RTL/Verilog/M1_files/time_sim.nga
ROM_RTL/Verilog/M1_files/time_sim.v
ROM_RTL/Verilog/M1_files/time_sim.sdf
ROM_RTL/Verilog/M1_files/time_sim.tv
ROM_RTL/Verilog/M1_files/time_sim.pin
ROM_RTL/Verilog/M1_files/rom_rtl.bgn
ROM_RTL/Verilog/M1_files/rom_rtl.drc
ROM_RTL/Verilog/M1_files/rom_rtl.bit
ROM_RTL/Verilog/command.log
ROM_RTL/Verilog/rom_rtl.fpga
ROM_RTL/Verilog/rom_rtl.timing
ROM_RTL/Verilog/rom_rtl.sxnf
ROM_RTL/Verilog/rom_rtl.db
ROM_RTL/Verilog/rom_rtl.ncf
ROM_RTL/Verilog/dc2ncf.log
ROM_RTL/Verilog/rom_rtl.dc
ROM_RTL/Verilog/rom_rtl.rar
ROM_RTL/Verilog/M1_files
ROM_RTL/Verilog
ROM_RTL
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